參數(shù)資料
型號(hào): XRT94L33IB-L
廠商: Exar Corporation
文件頁數(shù): 60/465頁
文件大?。?/td> 0K
描述: IC MAPPER DS3/E3/STS-1 504TBGA
標(biāo)準(zhǔn)包裝: 24
應(yīng)用: 網(wǎng)絡(luò)切換
接口: 總線
電源電壓: 3.14 V ~ 3.47 V
封裝/外殼: 504-LBGA
供應(yīng)商設(shè)備封裝: 504-TBGA(35x35)
包裝: 托盤
安裝類型: 表面貼裝
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
152
2.2.1.1
THE PINS OF THE TRANSMIT UTOPIA BUS INTERFACE
The ATM Layer processor will interface to the Transmit UTOPIA Interface block via the following pins.
TxUData[15:0] -
Transmit UTOPIA Data Bus Input pins
TxUAddr[4:0] -
Transmit UTOPIA Address Bus Input pins
TxUClk
Transmit UTOPIA Interface block clock input pin
TxUClkO
Transmit UTOPIA Interface block clock output pin
TxUSoC
Transmit “Start of Cell” indicator input pin
TxUPrty
Transmit UTOPIA - Odd Parity Input pin
TxUEnB*
Transmit UTOPIA Data Bus - Write Enable input pin
TxUClav/TFullB*
TxFIFO Cell Available
Each of these signals is briefly discussed below.
TxUData[15:0] - Transmit UTOPIA Data Bus inputs
The ATM Layer Processor will write its ATM Cell Data into the Transmit UTOPIA Interface block, by placing it,
in a byte-wide (or 16-bit word-wide) manner on these input pins. The Transmit UTOPIA Data Bus can be
configured to operate in the “8-bit wide” or “16-bit wide” mode (See Section _). If the “8-bit wide” mode is
selected, then only the TxUData[7:0] input pins are active and capable of accepting ATM cell data from the
ATM Layer Processor. If the “16-bit wide” mode is selected, the all 16 input pins (e.g., TxUData[15:0]) are
active. The Transmit UTOPIA Data bus is tri-stated while the active-low TxUEnB* (Transmit UTOPIA Data
Bus - Write Enable) input signal is “high”. Therefore, the ATM Layer processor must assert this signal (e.g.,
toggling TxUEnB* “l(fā)ow”) in order write the cell data, on the Transmit UTOPIA Data bus, into the Transmit
UTOPIA Interface Block.
The data on the Transmit UTOPIA Data Bus is sampled and latched into the
Transmit UTOPIA Interface block, on the rising edge of the Transmit UTOPIA Interface Block Clock signal,
TxUClk.
Additionally, the Transmit UTOPIA Interface block will only process one cell worth of data (e.g., 52, 53 or 54
bytes, as configured via the Cell_Size_Sel[1:0] option - See Section _), following the latest assertion of the
TxUSoC (Transmit-Start of Cell) pin. Afterwards, the Transmit UTOPIA Data bus will become tri-stated and
will cease to process any more data from the ATM Layer Processor until the next assertion of the TxUSoC
pin. Once the Transmit UTOPIA Interface block reaches this condition, it will ignore the assertions of the
TxUEnB* pin, and will keep the Transmit UTOPIA Data bus input pins tri-stated until the ATM Layer
Processor pulses the TxUSoC input pin, once again.
If the Transmit UTOPIA Interface block detects a “runt” cell (e.g., if the amount of data that is read into the
TxUFIFO is less than that configured via the “Cell_Size_Sel[1:0]” option), then the Transmit UTOPIA Interface
block will discard this cell, and resume normal operation.
TxUAddr[4:0] - Transmit UTOPIA Address Bus inputs
These input pins are only used when the XRT94L33 is operating in the Multi-PHY mode. Therefore, for more
information on the Transmit UTOPIA Address Bus, please see Section _.
TxUClk - Transmit UTOPIA Interface Block - Clock signal input pin
The Transmit UTOPIA Interface block uses this signal to sample and latch the data on the Transmit UTOPIA
Data bus into the Transmit UTOPIA Address block (for Multi-PHY operation) into the Transmit UTOPIA
Interface block. This clock signal can run at frequencies of up to 50 MHz.
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PDF描述
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XRT94L43A 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
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XRT94L43ES-LC03 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 OC12-12XDS3MAPPER SCORPION 4x T73LC03A RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel