參數(shù)資料
型號： XRT94L33IB-L
廠商： Exar Corporation
文件頁數(shù)： 385/465頁
文件大?。?/td> 0K
描述： IC MAPPER DS3/E3/STS-1 504TBGA
標(biāo)準(zhǔn)包裝： 24
應(yīng)用： 網(wǎng)絡(luò)切換
接口： 總線
電源電壓： 3.14 V ~ 3.47 V
封裝/外殼： 504-LBGA
供應(yīng)商設(shè)備封裝： 504-TBGA（35x35）
包裝： 托盤
安裝類型： 表面貼裝
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xr
XRT94L33
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
Rev.1.2.0.
445
CONFIGURATION OPTIONS WITH THE RECEIVE UTOPIA INTERFACE BLOCK
Selecting the UTOPIA Level
The XRT94L33 permits the user to configure the Receive UTOPIA Interface block in either of the following
“UTOPIA Levels”.
UTOPIA Level 3
UTOPIA Level 1 or 2
The user can configure the Receive UTOPIA Interface block (within the XRT94L33) to operate in the
appropriate UTOPIA Level, by writing the appropriate value into Bit 7 (UTOPIA Level) within the “Receive
UTOPIA Control Register”, as depicted below.
Receive UTOPIA/POS-PHY Control Register – Byte 0 (Address = 0x0503)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
UTOPIA
Level 3
Disable
Multi-PHY
Polling
Enable
Back to
Back Polling
Enable
Direct
Status
Indication
Enable
Receive UTOPIA/POS-PHY
Data Bus Width
Cell Size[1:0]
R/W
X
1
0
1
Setting this bit-field to “0” configures the Receive UTOPIA Interface block to support “UTOPIA Level 3”
signaling. Conversely, setting this bit-field to “1” configures the Receive UTOPIA Interface block to support
the “UTOPIA Levels 1 and 2” form of signaling.
A description of the operation of the Receive UTOPIA
Interface block, for UTOPIA Level 1, 2 and 3 operation is presented below.
2.3.5.1.2
UTOPIA Level 1 and 2 Operation of the Receive UTOPIA Interface Block
This section presents an in-depth write up of the UTOPIA Level 1 and 2 protocols.
When the Receive UTOPIA Interface block has been configured to operate in the “UTOPIA Level 2” Mode,
then it will either be configured to operate in the “Single-PHY” or “Multi-PHY” mode, as described below.
2.3.5.1.2.1
Selecting the UTOPIA Data Bus Width
The user can configure the width of the Receive UTOPIA Data Bus to be either 8 or 16 bits by writing the
appropriate data into Bits 3 and 2 (Receive UTOPIA Data Bus Width[1:0]) within the “Receive UTOPIA
Control” Register, as depicted below.
Receive UTOPIA/POS-PHY Control Register – Byte 0 (Address = 0x0503)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
UTOPIA
Level 3
Disable
Multi-PHY
Polling
Enable
Back to
Back Polling
Enable
Direct
Status
Indication
Enable
Receive UTOPIA/POS-PHY
Data Bus Width
Cell Size[1:0]
R/W
1
0
X
1
If the user chooses a UTOPIA Data Bus width of 8 bits, then only the Receive UTOPIA Data outputs:
RxUData[15:8] will be active.
(The output pins: RxUData[7:0] will not be active).
If the user chooses a
UTOPIA Data Bus width of 16 bits, then all of the Receive UTOPIA Data outputs: RxUData[15:0] will be
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PDF描述
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XRT94L43A 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
XRT94L43ES-L03 功能描述:界面開發(fā)工具 Eval System for XRT94L43 Series RoHS:否 制造商:Bourns 產(chǎn)品:Evaluation Boards 類型:RS-485 工具用于評估:ADM3485E 接口類型:RS-485 工作電源電壓:3.3 V
XRT94L43ES-LC03 功能描述:時鐘合成器/抖動清除器 OC12-12XDS3MAPPER SCORPION 4x T73LC03A RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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