參數(shù)資料
型號： XRT94L33IB-L
廠商： Exar Corporation
文件頁數(shù)： 341/465頁
文件大?。?/td> 0K
描述： IC MAPPER DS3/E3/STS-1 504TBGA
標(biāo)準(zhǔn)包裝： 24
應(yīng)用： 網(wǎng)絡(luò)切換
接口： 總線
電源電壓： 3.14 V ~ 3.47 V
封裝/外殼： 504-LBGA
供應(yīng)商設(shè)備封裝： 504-TBGA（35x35）
包裝： 托盤
安裝類型： 表面貼裝
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xr
XRT94L33
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
Rev.1.2.0.
405
When the HEC Byte Verification block is operating in the PRE-SYNC state, it will then begin to sample five (5)
“candidate header bytes” from the data within the incoming data-stream, repeatedly at 53 byte intervals.
During this sampling process, the HEC Byte Verification block will compute and compare its newly computed
“HEC byte value” with that of the fifth (read-in) octet. If the HEC Byte Verification block, while operating in the
PRE-SYNC state, comes across a single invalid cell header byte pattern, then the HEC Byte Verification block
will transition back to the “HUNT” state.
However, if the HEC Byte Verification block detects “DELTA”
consecutive valid cell byte headers, then it will transition into the SYNC state.
The SYNC State
Once the HEC Byte Verification block has transitioned into the “SYNC” state, then this means that the
Receive ATM Cell Processor block is “officially” delineation ATM cells. The Receive ATM Cell Processor
block will notify the Microprocessor (and external circuitry) of this transition into the SYNC state by doing all of
the following.
1. It will indicate that it as cleared the LCD defect condition by setting Bit 0 (LCD Defect Declared) and the
Bits 2 and 1 (Cell Delineation Status[1:0]) bit-fields, within the “Receive ATM Cell Processor Block – Receive
ATM Status Register” to “0”, as depicted below.
Receive ATM Cell Processor Block – Receive ATM Status Register (Address = 0xN707)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
PRBS Lock
Indicator
Cell Delineation Status[1:0]
LCD Defect
Declared
R/O
0
2. It will generate the “Clearance of LCD Defect Condition” interrupt. The Receive ATM Cell Processor block
will indicate that it is declaring the “Clearance of LCD Defect Condition” Interrupt by doing the following.
-
Toggling the “INT*” output pin “l(fā)ow”.
-
Setting Bit 1 (Clearance of LCD Defect Interrupt Status), within the “Receive ATM Cell
Processor Block – Receive ATM Interrupt Status Register – Byte 0” to “1” as depicted below.
Receive ATM Cell Processor Block – Receive ATM Interrupt Status Register – Byte 0 (Address =
0xN70B)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Receive
Cell
Insertion
Interrupt
Status
Receive
FIFO
Overflow
Interrupt
Status
Receive
Cell
Extraction
Memory
Overflow
Interrupt
Status
Receive
Cell
Insertion
Memory
Overflow
Interrupt
Status
Detection of
Correctable
HEC Byte
Error
Interrupt
Status
Detection of
Uncorrectable
HEC Byte
Error Interrupt
Status
Clearance
of LCD
Defect
Interrupt
Status
Declaration
of LCD
Defect
Interrupt
Status
RUR
0
1
0
Whenever the HEC Byte Verification block is operating in the SYNC state, it will tolerate a certain number of
errors in the header bytes of the incoming cells. Additionally, in some case, the HEC Byte Verification block
will even attempt to correct some of these errors. However, the occurrence of “ALPHA” consecutive cells with
header byte errors (single or multi-bit) will cause the HEC Byte Verification block to return to the “HUNT”
state. If this were to occur, then the Receive ATM Cell Processor block will notify the external circuitry that it
is not properly delineating cells by doing the following.
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PDF描述
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XRT94L43_06 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
XRT94L43A 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
XRT94L43ES-L03 功能描述:界面開發(fā)工具 Eval System for XRT94L43 Series RoHS:否 制造商:Bourns 產(chǎn)品:Evaluation Boards 類型:RS-485 工具用于評估:ADM3485E 接口類型:RS-485 工作電源電壓:3.3 V
XRT94L43ES-LC03 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 OC12-12XDS3MAPPER SCORPION 4x T73LC03A RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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