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參數(shù)資料
| 型號： | XRT94L33IB-L |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 343/465頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應(yīng)商設(shè)備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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xr
XRT94L33
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
Rev.1.2.0.
407
2.3.4.1.2
HEC Byte VerificationOnce the HEC Byte Verification block is properly delineating cells, then
the HEC Byte Verification block will (as its name implies) perform “HEC Byte Verification” of incoming cells
data from the Receive STS-3c POH Processor block in order to protect against misrouted or mis-inserted
cells. In performing HEC Byte Verification the HEC Byte Verification block will take the first four byte of each
cells (e.g., the header bytes) and will independently compute its own value for the HEC byte. Afterwards, the
HEC Byte Verification block will compare its value of the HEC byte with the fifth octet that it has received from
the Receive STS-3c POH Processor block. If the two “HEC byte” values match then the “Receive ATM Cell
Processor” block will retain this cell for further processing.
However, if the HEC Byte Verification block
detects errors in the header bytes of a cell, then the HEC Byte Verification block will call up and employ the
“HEC Byte Error Correction/Detection” Algorithm (see below).
The HEC Byte Verification block will compute its version of the HEC byte via the generating polynomial x
8 + x2
+ x + 1. The user should be aware that the HEC bytes of the incoming cell might have been modulo-2 added
with the Coset polynomial x
6 + x4 + x2 + 1. If this is the case then the Receive ATM Cell Processor block must
be configured to account for this by writing a “1” to Bit 1 (COSET Polynomial Addition) within the “Receive
ATM Cell Processor Block – Receive ATM Control Register – Byte 1.
Receive ATM Cell Processor Block – Receive ATM Control Register – Byte 1 (Address = 0xN702)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
GFC
Extraction
Enable
HEC Byte
Correction
Enable
Uncorrectable
HEC Byte
Error Discard
COSET
Polynomial
Addition
Regenerate
HEC Byte
Enable
R/O
R/W
0
1
0
1
0
The “HEC Byte Error Correction/Detection” Algorithm
If the HEC Byte Verification block detects one or more errors in the header bytes of a given incoming ATM
cell, then the “HEC Byte Error Correction/Detection” algorithm will be employed.
The “HEC Byte Error
Correction/Detection” Algorithm has two states: “Detection” Mode and “Correction” Mode.
Figure 99 presents a State Machine Diagram of the “HEC Byte Error Correction/Detection” Algorithm. Each
of these states is discussed below.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT94L43IB-F | IC MAPPER SONET/SDH OC12 516BGA |
| XS1-G02B-FB144-I4 | IC MCU 32BIT 16KB OTP 144FBGA |
| XTR114U/2K5 | IC 4-20MA I-TRANSMITTER 14-SOIC |
| ZXHF5000JB24TC | IC SWITCH QUAD 2X1 24QFN |
| 3341-56 | IC PLL INTEGER-N 3GHZ 20QFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT94L43 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH STS-12/STM-4 TO E3/DS3/STS-1 MAPPER/DEMAPPER |
| XRT94L43_06 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
| XRT94L43A | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
| XRT94L43ES-L03 | 功能描述:界面開發(fā)工具 Eval System for XRT94L43 Series RoHS:否 制造商:Bourns 產(chǎn)品:Evaluation Boards 類型:RS-485 工具用于評估:ADM3485E 接口類型:RS-485 工作電源電壓:3.3 V |
| XRT94L43ES-LC03 | 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 OC12-12XDS3MAPPER SCORPION 4x T73LC03A RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
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