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參數(shù)資料
| 型號： | XRT94L33IB-L |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 444/465頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應(yīng)商設(shè)備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
8
PIN #
SIGNAL NAME
I/O
SIGNAL
TYPE
DESCRIPTION
AD18
PRDY_L/
DTACK*
RDY
O
CMOS
READY or DTACK Output:
The exact function of this input pin depends upon wich mode the
Microprocessor Interface has been configured to operate in, as
described below.
Intel Asynchronous Mode – RDY* - READY output:
If the Microprocessor Interface has been configured to operate in
the Intel-Asyncrhronous Mode, then this output pin will function
as the “active-low” READY output.
During a READ or WRITE cycle, the Microprocessor Interface
block will toggle this output pin to the logic “l(fā)ow” level ONLY
when it (the Microprocessor Interface) is ready to complete or
terminate the current READ or WRITE cycle.
Once the
Microprocessor has determined that this input pin has toggled to
the logic “l(fā)ow” level, then it is now safe for it to move on and
execute the next READ or WRITE cycle.
If (during a READ or WRITE cycle) the Microprocessor Interface
block is holding this output pin at a logic “high” level, then the
MIcroprocessor is expected to extend this READ or WRITE
cycle, until it detect this output pin being toggled to the logic low
level.
Motorola Mode – DTACK* - Data Transfer Acknowledge
Output:
If the Microprocessor Interface has been configured to operate in
the Motorola-Asynchronous Mode, then this output pin will
function as the “active-low” DTACK* ouytput.
During a READ or WRITE cycle, the Microprocessor Interface
block will toggle this output pin to the logic low level, ONLY when
it (the Microprocessor Interface) is ready to complete or
terminate the current READ or WRITE cycle.
Once the
Microprocessor has determined that this input pin has toggled to
the logic “l(fā)ow” leve, then it is now safe for it to move on and
execute the next READ or WRITE cycle.
If (during a READ or WRITE cycle) the Microprocessor Interface
block is holding this output pin at a logic “high” level, then the
MIcroprocessor is expected to extend this READ or WRITE
cycle, until it detects this output pin being toggled to the logic low
level.
PowerPC 403 Mode – RDY – Ready Output:
If the Microprocessor Interface has been configured to operate in
the PowerPC 403 Mode, then this output pin will function as the
“active-high” READY output.
During a READ or WRITE cycle, the Microprocessor Interface
block will toggle this output pin to the logic high level, ONLY
when it (the Microprocessor Interface) is ready to complete or
terminate the current READ or WRITE cycle.
Once the
Microprocessor has sampled this signal being at a logic “high”
level (upon the rising edge of PCLK) then it is now safe for it to
move on and execute the next READ or WRITE cycle.
The Microprocessor Interface will update the state of this output
pin upon the rising edge of PCLK.
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PDF描述 |
|---|---|
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參數(shù)描述 |
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| XRT94L43A | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
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| XRT94L43ES-LC03 | 功能描述:時鐘合成器/抖動清除器 OC12-12XDS3MAPPER SCORPION 4x T73LC03A RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
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