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參數(shù)資料
| 型號： | XRT94L33IB-L |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 36/465頁 |
| 文件大小： | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標準包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應(yīng)商設(shè)備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L33
xr
Rev.1.2.0.
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
130
Figure 4 Behavior of Microprocessor Interface signals during an “Intel-type” Programmed I/O Read
Operation
ALE_AS
RDB_DS
A[14:0]
CS*
D[7:0]
Rdy_Dtck
Not Valid
Valid
Address of Target Register
WRB_RW
ALE_AS
RDB_DS
A[14:0]
CS*
D[7:0]
Rdy_Dtck
Not Valid
Valid
Address of Target Register
WRB_RW
1.3.3.2
THE INTEL MODE WRITE CYCLE
Whenever an Intel-type
C/P wishes to write a byte or word of data into a register or buffer location, within
the XRT94L33, it should do the following.
1. Assert the ALE_AS (Address Latch Enable) input pin by toggling it “high”. When the
C/P asserts the
ALE_AS input pin, it enables the “Address Bus Input Drivers” within the XRT94L33 chip.
2. Place the address of the “target” register or buffer location within the XRT94L33, on the Address Bus input
pins, A[14:0].
3. While the
C/P is placing this address value onto the Address Bus, the Address Decoding circuitry (within
the user’s system) should assert the CS* input pin of the XRT94L33 by toggling it “l(fā)ow”. This step enables
further communication between the
C/P and the XRT94L33 Microprocessor Interface block.
4. After allowing the data on the Address Bus pins to settle (by waiting the appropriate “Address Setup” time);
the
C/P should toggle the ALE_AS input pin “l(fā)ow”. This step causes the XRT94L33 to “l(fā)atch” the contents
of the “Address Bus” into its internal circuitry. At this point, the address of the register or buffer location within
the XRT94L33, has now been selected.
5.
Next, the
C/P should indicate that this current bus cycle is a “Write” Operation; by toggling the
WRB_RW (Write Strobe) input pin “l(fā)ow”. This action also enables the “bi-directional” data bus input drivers of
the XRT94L33.
6. The
C/P should then place the byte or word that it intends to write into the “target” register, on the bi-
directional data bus, D[7:0].
7. After waiting the appropriate amount of time, for the data (on the bi-directional data bus) to settle; the
C/P should toggle the WRB_RW (Write Strobe) input pin “high”. This action accomplishes two things:
a. It latches the contents of the bi-directional data bus into the XRT94L33 Microprocessor Interface
block.
b. It terminates the write cycle.
Figure 5 presents a timing diagram which illustrates the behavior of the Microprocessor Interface signals,
during an “Intel-type” Programmed I/O Write Operation.
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