參數資料
| 型號： | XRT94L33IB-L |
| 廠商： | Exar Corporation |
| 文件頁數： | 117/465頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER DS3/E3/STS-1 504TBGA |
| 標準包裝： | 24 |
| 應用： | 網絡切換 |
| 接口： | 總線 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 封裝/外殼： | 504-LBGA |
| 供應商設備封裝： | 504-TBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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xr
XRT94L33
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
Rev.1.2.0.
203
0
1
0
Finally, the Transmit ATM Cell Processor block will increment the “Transmit ATM Cell – HEC Byte Error
Count” register.
The “Transmit ATM Cell” HEC Byte Error Count Register is a 32-bit “RESET-upon-
READ” register. The bit-format for this register is presented below.
Transmit ATM Cell – HEC Byte Error Count Register – Byte 3 (Address = 0xNF30)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_HEC_Byte_Error_Count[31:24]
RUR
0
Transmit ATM Cell – HEC Byte Error Count Register – Byte 2 (Address = 0xNF31)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_HEC_Byte_Error_Count[23:16]
RUR
0
Transmit ATM Cell – HEC Byte Error Count Register – Byte 1 (Address = 0xNF32)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_HEC_Byte_Error_Count[15:8]
RUR
0
Transmit ATM Cell – HEC Byte Error Count Register – Byte 0 (Address = 0xNF33)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_HEC_Byte_Error_Count[7:0]
RUR
0
In general, if the HEC Byte Calculation & Insertion block detects ATM cells that contains “Single-Bit” or “Multi-
Bit” errors (within the Header bytes), then it will NOT correct these Header byte errors. Further, the Transmit
ATM Cell Processor block will automatically discard these erred cells unless it has been configured to
recalculate and insert a new HEC byte into the 5
th octet position of each ATM cell (as discussed below in
Section 4.2.2.7.2).
Note:
The Transmit ATM Cell – HEC Byte Error Count Register will be incremented by the value “1” each time the
Transmit ATM Cell Processor detects a HEC byte error in the incoming ATM cell stream. This 32-bit register
will continue to be incremented until it reaches the value “0xFFFFFFFF”. At this point, this RESET-upon-READ
register will saturate and will not increment any further, until the Microprocessor reads out the contents of these
registers.
If the user does not wish to configure the “HEC Byte Calculation & Insertion” block to check for HEC byte
errors in the incoming ATM cell data-stream, then they should set Bit 6 (HEC Byte Check Enable), within the
Transmit ATM Control – Byte 0 register to “0” as indicated below.
相關PDF資料 |
PDF描述 |
|---|---|
| XRT94L43IB-F | IC MAPPER SONET/SDH OC12 516BGA |
| XS1-G02B-FB144-I4 | IC MCU 32BIT 16KB OTP 144FBGA |
| XTR114U/2K5 | IC 4-20MA I-TRANSMITTER 14-SOIC |
| ZXHF5000JB24TC | IC SWITCH QUAD 2X1 24QFN |
| 3341-56 | IC PLL INTEGER-N 3GHZ 20QFN |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| XRT94L43A | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-12 TO 12XDS3/E3 MAPPER |
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