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參數(shù)資料
| 型號(hào)： | XRT84L38 |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 280/453頁(yè) |
| 文件大?。?/td> | 2982K |
| 代理商： | XRT84L38 |
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XRT84L38
260
OCTAL T1/E1/J1 FRAMER
REV. 1.0.1
Transmit Single-frame Synchronization signal of Channel 0 pulses HIGH at the beginning of the frame with
data from Channel 0-3 multiplexed together. The Transmit Single-frame Synchronization signal of Channel 4
pulses HIGH at the beginning of the frame with data from Channel 4-7 multiplexed together. It is responsibility
of the Terminal Equipment to align the multiplexed transmit serial data with the Transmit Single-frame
Synchronization pulse. Additionally, each channel requires the local Terminal Equipment to provide a free-
running 2.048 MHz clock into the Transmit Serial Clock input.
The table below summaries the clock frequencies of TxSerClk_n and TxInClk_n inputs when the framer is
operating in multiplexed High-speed Back-plane mode.
The Transmit Serial Clock is always running at 1.544MHz for all the High-speed Back-plane Interface modes. It
is automatically the timing source of the Transmit Section of the framer in High-speed Back-plane Interface
mode.
The Transmit Single-frame Synchronization signal should pulse HIGH or LOW for one bit period at the First bit
position of each E1 frame. Length of the bit period depends on data rate of the High-speed Back-plane
Interface. The Transmit Synchronization Pulse Low bit of the Transmit Interface Control Register (TICR)
determines whether the Transmit Single-frame Synchronization signal is HIGH active or LOW active.
The table below shows configurations of the Transmit Synchronization Pulse LOW bit of the Transmit Interface
Control Register (TICR).
TRANSMIT INTERFACE CONTROL REGISTER (TICR) (NDIRECT ADDRESS = 0XN0H, 0X20H)
Throughout the discussion of this datasheet, we assume that the Transmit Single-frame Synchronization signal
pulses HIGH unless stated otherwise.
The TxMSync_n signal, which is a multiplexed I/O pin, no longer functions as the Transmit Multi-frame
Synchronization Signal. Indeed, it becomes the Transmit Input Clock signal (TxInClk) of the High-speed Back-
plane Interface of the framer. The local Terminal Equipment should provide a free-running clock with the same
frequency as the High-speed Back-plane Interface to this input pin.
The following sections discuss details of how to operate the framer in different Back-plane interface speed
mode and how to connect the Transmit Payload Data Input Interface block to the local Terminal Equipment.
6.1.3.1
E1 Transmit Input Interface - MVIP 2.048 MHz
When the Transmit Multiplex Enable bit is set to zero and the Transmit Interface Mode Select [1:0] bits are set
to 01, the Transmit Back-plane interface of framer is running at a data rate of 2.048Mbit/s.
TRANSMIT MULTIPLEX ENABLE BIT = 1
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
B
IT
1
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
B
IT
0
B
ACK
-
PLANE
I
NTERFACE
D
ATA
R
ATE
T
X
S
ER
C
LK
T
X
MS
YNC
/T
X
C
LK
0
0
-
-
-
0
1
Bit-multiplexed
16.384Mbit/s
2.048 MHz
16.384 MHz
1
0
HMVIP 16.384Mbit/s
2.048 MHz
16.384 MHz
1
1
H.100 16.384Mbit/s
2.048 MHz
16.384 MHz
B
IT
N
UMBER
B
IT
N
AME
B
IT
T
YPE
B
IT
D
ESCRIPTION
3
Transmit
Synchronization
Pulse LOW
R/W
0 - The Transmit Single-frame Synchronization signal will pulse HIGH indicat-
ing the beginning of an E1 frame when the High-speed Back-plane Interface is
running at a mode other than the XRT84V24 Compatible 2.048Mbit/s.
1 - The Transmit Single-frame Synchronization signal will pulse LOW indicat-
ing the beginning of an E1 frame when the High-speed Back-plane Interface is
running at a mode other than the XRT84V24 Compatible 2.048Mbit/s.
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