參數(shù)資料
型號(hào)： SPD6729QCE
廠商： INTEL CORP
元件分類(lèi)： 總線控制器
英文描述： PCMCIA BUS CONTROLLER, PQFP208
封裝： MQFP-208
文件頁(yè)數(shù)： 52/116頁(yè)
文件大?。?/td> 1442K
代理商： SPD6729QCE
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PD6729 — PCI-to-PC Card (PCMCIA) Controller
40
Datasheet
5.4
Cache Line Size, Latency Timer, Header Type, and BIST
Bits 31:24 BIST Register
These bits will always read back 00h. The PD6729 uses proprietary manufacturing test methods
instead of BIST test features.
Bits 23:16 Header Type Register
These bits will always read back 00h and specifies that the PD6729 uses the standard type 00
configuration space header register layout for configuration bytes 10h through 3Fh.
Bits 31:24 Latency Timer Register
Since the PD6729 does not use bus mastering, this bit field is always 00h.
Bits 7:0 BIST Register
These bits will always read back 00h, indicating that the PD6729 does not participate in PCI-
defined caching algorithms.
Configuration Register Name: Cache Line Size, Latency Timer, Header Type, and
BIST
Offset: 0Ch
Register Per: chip
Bit 31
Bit 30
Bit 29
Bit 28
Bit 27
Bit 26
Bit 25
Bit 24
3
BIST
Reserved
R:XXXXXXXX
Bit 23
Bit 22
Bit 21
Bit 20
Bit 19
Bit 18
Bit 17
Bit 16
2
Header
Type
Header Type
R:00000000
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
1
Latency
Timer
Reserved
R:XXXXXXXX
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
0
Cache
Line Size
Reserved
R:XXXXXXXX
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PDF描述
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SPL505YC264BT 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO64
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