參數(shù)資料
型號： SPD6729QCE
廠商： INTEL CORP
元件分類： 總線控制器
英文描述： PCMCIA BUS CONTROLLER, PQFP208
封裝： MQFP-208
文件頁數(shù)： 22/116頁
文件大?。?/td> 1442K
代理商： SPD6729QCE
PCI-to-PC Card (PCMCIA) Controller — PD6729
Datasheet
13
2.1
Pin Diagram
2.2
Pin Description Conventions
The following conventions apply to the pin description tables in “Pin Descriptions” on page 15:
A pound sign (#) at the end of a pin name indicates an active-low signal for the PCI bus.
A dash (-) at the beginning of a pin name indicates an active-low signal for the PCMCIA bus.
Figure 3. PD6729 Pin Diagram
160
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PD6729
208-Pin MQFP
+5V
B_SOCKET_VCC
A_SOCKET_VCC
PCI_VCC
2
3
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5
6
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51
50
52
1
B_A11
B_-IORD
B_A9
B_-IOWR
B_SOCKET_VCC
B_A8
B_A17
B_A13
B_A18
B_A14
B_A19
B_-WE
B_A20
B_RDY/-IREQ
B_A21
B_A16
B_A22
B_A15
B_A23
B_A12
RING_GND
B_A24
B_A7
B_A25
B_A6
B_VS2
B_A5
B_RESET
B_A4
B_-WAIT
B_A3
B_SOCKET_VCC
B_-INPACK
B_A2
B_A1
B_BVD2/-SPKR/-LED
B_A0
B_BVD1/-STSCHG/-RI
B_D0
B_D8
B_D1
B_D9
B_D2
B_D10
B_WP/-IOIS16
B_-CD2
IRQ3/INTA#
IRQ4/INTB#
IRQ5/INTC#
IRQ7/INTD#
RST#
NC
B_
-O
E
B_
-C
E
2
B_
A1
0
B_
D
1
5
B_
-C
E
1
B_
D
1
4
B_
D
7
B_
D
1
3
B_
D
6
B_
D
1
2
B_
D
5
B_
D
1
B_
D
4
B
_
-CD1
B_
D
3
B_
-R
E
G
RING
_G
ND
B_
-V
C
_
5
B_
-V
C
_
3
B_
VP
P_
V
C
B_
VP
P_
P
G
M
LE
D_O
U
T
*
S
PKR
_
O
U
T
*
+5V
A_
-V
C
_
5
A_
-V
C
_
3
A_
VP
P_
V
C
A_
VP
P_
P
G
M
A
_
-CD2
A
_
W
P
/-
IO
IS
16
A_
D
1
0
A_
D
2
A_
D
9
A_
D
1
A_
D
8
A_
D
0
A
_
B
V
D1/-
S
T
S
CHG
/-
RI
A_
A0
A_
BV
D
2
/-
SP
KR
/-
L
E
D
A_
A1
A_
A2
A_
-I
N
P
A
C
K
A_
A3
A_
-W
AI
T
A_
A4
A_
R
E
S
E
T
A_
A5
CO
RE
_V
DD
B_
VS
1
A_
A6
A_
V
S
2
A_A7
A_A24
A_SOCKET_VCC
A_A12
A_A23
A_A15
A_A22
A_A16
A_A21
A_RDY/-IREQ
A_A20
A_-WE
A_A19
RING_GND
A_A14
A_A18
A_A13
A_A17
A_A8
A_-IOWR
A_A9
A_-IORD
A_A11
A_VS1
A_-CE2
A_SOCKET_VCC
A_A10
A_D15
A_-CE1
A_D14
A_D13
A_D7
A_D6
A_D12
A_D5
A_D11
A_D4
A_-CD1
A_D3
A_-REG
IRQ15/RI_OUT*
IRQ14/EXT_CLK
IRQ12
IRQ11
IRQ10
IRQ9
AD0
RING_GND
AD1
AD2
A_-OE
AD3
PC
I_
C
L
K
NC
CO
RE
_G
ND
AD
3
1
AD
3
0
AD
2
9
PC
I_
V
C
AD
2
8
AD
2
7
AD
2
6
AD
2
5
AD
2
4
C/
B
E
3
#
RING
_G
ND
IDS
E
L
AD
2
3
AD
2
AD
2
1
AD
2
0
AD
1
9
PC
I_
V
C
AD
1
8
AD
1
7
AD
1
6
C/
B
E
2
#
F
R
AM
E#
RING
_G
ND
IR
D
Y
#
TR
D
Y
#
D
E
VS
EL
#
ST
OP
#
PA
R
C/
B
E
1
#
PC
I_
V
C
AD
1
5
AD
1
4
AD
1
3
AD
1
2
AD
1
AD
1
0
RING
_G
ND
AD
9
AD
8
C/
B
E
0
#
AD
7
AD
6
PC
I_
V
C
AD
5
AD
4
P
E
RR#
S
E
RR#
A_
A2
5
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PDF描述
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SPL505YC264BT 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO64
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參數(shù)描述
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