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參數(shù)資料
| 型號(hào)： | PTM1300 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Programmable Media Processor |
| 中文描述： | 可編程的媒體處理器 |
| 文件頁(yè)數(shù)： | 516/533頁(yè) |
| 文件大?。?/td> | 6857K |
| 代理商： | PTM1300 |
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Index-4
PRODUCT SPECIFICATION
data cache
coherency
5-11
dcb operation
5-6
dinvalid operation
5-6
initialization
5-8
LRU replacement
5-11
performance evaluation support
5-12
rdstatus operation
5-6
rdtag operation
5-6
data cache locking registers
5-5
data format
planar
14-3
DC/AC Characteristics
1-11
DC_LOCK_ADDR
description table
5-13
register
5-5
DC_LOCK_CTL
description table
5-13
register
5-5
DC_LOCK_SIZE
description table
5-13
register
5-5
DC_PARAMS
description table
5-13
fields
5-3
picture
5-3
DC_PARAMS register
5-3
dcb
5-6
,
A-20
dcb operation
5-6
DDS
7-3
,
8-2
debug frontend
18-3
debug support
3-13
DEST_ADR
PCI interface MMIO register
11-14
picture
11-10
device control
3-7
device ID
PCI interface register
11-3
device interrupts
3-11
diagnostic mode
8-7
audio in unit
8-7
dimensions
1-10
dinvalid
5-6
,
A-21
dinvalid operation
5-6
direct digital synthesizer
7-3
,
8-2
dirty bit
5-4
dithering
14-10
algorithm
14-10
method
14-10
DMA operations
PCI interface
11-2
DMA_CTL
PCI interface MMIO register
11-14
picture
11-10
Dolby Digital output
1-1
downscaling
14-1
DPC
definition
3-3
DRAM aperture
5-2
DRAM base
5-2
DRAM limit
5-2
DRAM memory system
address aperture
12-1
address mapping
12-5
circuit board design
12-6
connection to TM1000
12-1
example block diagrams
12-8
example configurations table
12-4
features
12-1
granularity and sizes
12-2
initialization
12-5
mode register setting
12-5
on-chip interleaving
12-5
output driver capacity
12-6
overview
12-1
power down mode
12-6
programming
12-3
refresh
12-6
signal pins
12-5
supported devices
12-2
supported rank configurations
12-2
DRAM_BASE
description table
5-13
PCI interface MMIO register
11-9
PCI interface register
11-7
picture
5-2
,
11-10
DRAM_BASE updates
11-9
DRAM_CACHEABLE_LIMIT
description table
5-13
picture
5-5
DRAM_LIMIT
description table
5-13
picture
5-2
DSPCPU
addressing modes
3-4
byte ordering
3-2
register model
3-1
software compatibility
3-4
DSPCPU operations
listed alphabetically
A-1
listed by function
A-2
dspiabs
A-22
dspiadd
A-23
dspidualabs
A-24
dspidualadd
A-25
dspidualmul
A-26
相關(guān)PDF資料 |
PDF描述 |
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