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參數(shù)資料
| 型號(hào)： | PTM1300 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Programmable Media Processor |
| 中文描述： | 可編程的媒體處理器 |
| 文件頁數(shù)： | 449/533頁 |
| 文件大?。?/td> | 6857K |
| 代理商： | PTM1300 |
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Philips Semiconductors
DSPCPU Operations for TM1300
PRODUCT SPECIFICATION
A-163
32-bit store
pseudo-op for h_st32d(0)
SYNTAX
[ IF rguard ] st32 rsrc1 rsrc2
FUNCTION
if
rguard
then {
if
PCSW.bytesex = LITTLE_ENDIAN
then
bs
←
3
else
bs
←
0
mem[rsrc1+ (3
⊕
bs)]
←
rsrc2<7:0>
mem[rsrc1+ (2
⊕
bs)]
←
rsrc2<15:8>
mem[rsrc1+ (1
⊕
bs)]
←
rsrc2<23:16>
mem[rsrc1+ (0
⊕
bs)]
←
rsrc2<31:24>
}
ATTRIBUTES
Function unit
Operation code
Number of operands
Modifier
Modifier range
Latency
Issue slots
dmem
31
2
No
—
n/a
4, 5
DESCRIPTION
The
st32
operation is a pseudo operation transformed by the scheduler into an
h_st32d(0)
with the same
arguments. (Note: pseudo operations cannot be used in assembly files.)
The
st32
operation stores all 32 bits of rsrc2 into the memory locations pointed to by the address in rsrc1 The d
value is an opcode modifier and must be a multiple of 4. This store operation is performed as little-endian or big-
endian depending on the current setting of the bytesex bit in the PCSW.
If
st32
is misaligned (the memory address in rsrc1 is not a multiple of 4), the result of
st32
is undefined, and the
MSE (Misaligned Store Exception) bit in the PCSW register is set to 1. Additionally, if the TRPMSE (TRaP on
Misaligned Store Exception) bit in PCSW is 1, exception processing will be requested on the next interruptible jump.
The
st32
operation can be used to access the MMIO address aperture (the result of MMIO access by 8- or 16-bit
memory operations is undefined). The state of the BSX bit in the PCSW has no effect on MMIO access by
st32
.
The
st32
operation optionally takes a guard, specified in rguard If a guard is present, its LSB controls the
modification of the addressed memory locations (and the modification of cache if the locations are cacheable). If the
LSB of rguard is 1, the store takes effect. If the LSB of rguard is 0, st32 has no side effects whatever; in particular, the
LRU and other status bits in the data cache are not affected.
EXAMPLES
Initial Values
Operation
Result
r10 = 0xd00, r80 = 0x44332211
st32 r10 r80
[0xd00]
←
0x44, [0xd01]
←
0x33,
[0xd02]
←
0x22, [0xd03]
←
0x11
no change, since guard is false
r50 = 0, r20 = 0xd01,
r70 = 0xaabbccdd
r60 = 1, r30 = 0xd04,
r70 = 0xaabbccdd
IF r50 st32 r20 r70
IF r60 st32 r30 r70
[0xd04]
←
0xaa, [0xd05]
←
0xbb,
[0xd06]
←
0xcc, [0xd07]
←
0xdd
SEE ALSO
h_st32d st32d st16 st16d
st8 st8d
st32
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PDF描述 |
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