參數(shù)資料
型號： PCF5083
廠商： NXP Semiconductors N.V.
英文描述： STEEL COVER
中文描述： GSM信號處理IC
文件頁數(shù)： 8/136頁
文件大?。?/td> 602K
代理商： PCF5083
1996 Oct 29
8
Philips Semiconductors
Objective specification
GSM signal processing IC
PCF5083
AUXON
LOWVOLT
POWON
NPOWON
RST
33
34
35
36
37
I
I
O
O
I
Auxiliary Switch on input (active HIGH, CMOS level Schmitt trigger input).
Low battery indication (active LOW, CMOS level Schmitt trigger input).
Power Regulator on (active HIGH).
Power Regulator on (active LOW).
Asynchronous Reset for timer section (active LOW, CMOS level Schmitt trigger
input).
The 32.768 kHz CMOS level output for PCF5083-2B and PCF5083-2C.
The 26 MHz CMOS level output for PCF5083-3.
RS232 transmit data output (open-drain output).
RS232 receive data input.
RS232 input buffer full indication (active LOW, open-drain output).
MMI clock request (active HIGH, CMOS level Schmitt trigger input).
MMI clock 13 MHz.
IOM
-2 frame pulse (3-state).
IOM
-2 clock (3-state).
IOM
-2 data input (CMOS level Schmitt trigger input).
IOM
-2 data output (open drain output).
Ground core.
Supply I/O pin.
Ground I/O pin.
Supply core.
RF
IC interface shift clock (3-state).
RF
IC Interface Enable 1(active LOW, 3-state).
RF
IC Interface Enable 2 (active LOW, 3-state).
RF
IC Interface Enable 3 (active LOW, 3-state).
RF
IC Interface Enable 4 (active LOW, 3-state).
Supply core.
Ground for PLL.
RF
IC Interface data in.
RF
IC Interface data out (3-state).
RF
IC Interface Enable (active HIGH, 3-state).
Reference oscillator power-down (active LOW, 3-state).
CLK32K
CLK26M
TXD
RXD
MMIEN
MMIREQ
MMICLK
FSC
DCL
DU
DD
V
SS2
V
DD1
V
SS1
V
DD2
RFCLK
RFEN1
RFEN2
RFEN3
RFEN4
V
DD2
V
SSPLL
RFDI
RFDO
RFE
NREFON
38
O
39
40
41
42
43
44
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46
47
48
49
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54
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58
59
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61
62
O
I
O
I
O
I/O
I/O
I
O
O
O
O
O
O
I
O
O
O
SYMBOL
PIN
I/O
DESCRIPTION
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