參數(shù)資料
型號： PCF5083
廠商： NXP Semiconductors N.V.
英文描述： STEEL COVER
中文描述： GSM信號處理IC
文件頁數(shù)： 119/136頁
文件大?。?/td> 602K
代理商： PCF5083
1996 Oct 29
119
Philips Semiconductors
Objective specification
GSM signal processing IC
PCF5083
RF Device Control Bus timing - Mode 2
(see Fig.33; note 12)
1
2
3
4
5
6
7
(7)
8
RFEN1 to RFEN4 setup time to RFCLK HIGH
RFEN1 to RFEN4 hold time after RFCLK LOW
RFCLK LOW time
RFCLK HIGH time
RFDO setup time to RFCLK HIGH
RFDO hold time after RFCLK LOW
RFDI setup time to RFCLK LOW
RFE setup time to RFEN1 to RFEN4 LOW
70
4t
13
14t
13
6t
13
6t
13
4t
13
2t
13
6t
13
ns
ns
ns
ns
ns
ns
ns
ns
Baseband Interface timing (DSP Core X_Port)
(see Fig.34)
1
2
3
4
5
6
7
8
10
11
12
13
14
15
SIXEN setup to SIXCLK HIGH
SIXD setup to SIXCLK HIGH
SIXD hold time after SIXCLK HIGH
SIXEN hold time after SIXCLK HIGH
SIXCLK frequency
SIXCLK LOW time
SIXCLK HIGH time
SOXEN setup time to SOXCLK LOW
SOXD hold time after SOXCLK LOW
SOXEN hold time after SOXCLK LOW
SOXD 3-state after SOXEN HIGH
SOXCLK frequency
SOXCLK LOW time
SOXCLK HIGH time
5
5
10
10
20
20
20
10
20
20
13
0.27
1800
1800
40
20
13
ns
ns
ns
ns
MHz
ns
ns
ns
ns
ns
ns
MHz
ns
ns
IOM -2 Interface timing
(see Figs 35 and 36)
1
(7)
DD hold time after DCL HIGH
2a
(13)
DCL cycle time
2b
(13)
DCL cycle time
2c
(13)
DCL frequency
3
(7)
FSC hold time after DCL HIGH
4
(7)
DU setup time to DCL LOW
5
(7)
DU hold time after DCL LOW
6
(13)(7)
DCL HIGH time
7
(13)(7)
DCL LOW time
30
30
50
50
75
75
8.5t
13
8t
13
4.096
30
30
ns
ns
ns
MHz
ns
ns
ns
ns
ns
NO
PARAMETER
MIN.
TYP.
MAX.
UNIT
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