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參數(shù)資料
| 型號： | PCF5083 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | STEEL COVER |
| 中文描述： | GSM信號處理IC |
| 文件頁數(shù)： | 102/136頁 |
| 文件大?。?/td> | 602K |
| 代理商： | PCF5083 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁當(dāng)前第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁
1996 Oct 29
102
Philips Semiconductors
Objective specification
GSM signal processing IC
PCF5083
Table 78
Mode Control Registers 0 and 1
Note
1.
RSTx = 0 means reset condition if either RSTO or RSTC is asserted; ‘
’ denotes not affected from reset line.
During reset (RST, RSTO, RSTC) only those registers with an explicitly given reset value are affected. All other
registers are undefined and have to be set by the controller.
Table 79
Polarity Register (Power-Down Control Lines)
Note
1.
RSTx = 0 means reset condition if either RSTO or RSTC is asserted; ‘
’denotes not affected from reset line.
During reset (RST, RSTO, RSTC) only those registers with an explicitly given reset value are affected. All other
registers are undefined and have to be set by the controller.
BIT
R/W
SYMBOL
OPERATION (if bit is set)
RST = 0
RSTx = 0
(1)
0
1
2
3
4
5
6
7
8
9
10
11
12
13
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
RECRX
RECTX
RECMON
RECON
SEND
DTX
RXLENGTH0
RXLENGTH1
MONLENGTH0
MONLENGTH1
TXLENGTH
RXCAL
DISFRAMEINT
USEMODE
Generate the Rx burst timing
Generate the MON burst timing during the TX timeslot
Generate the MON burst timing
Generate the idle frame timing
Generate the TX burst timing
Enable DTX mode
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Select RXLENGTHx_REG for the Rx burst
Select RXLENGTHx_REG for the MON burst
Select TXLENGTHx_REG for the TX burst
Generate the RX calibration timing
Disable the frame interrupt
Select MODEx_REG for the next frame
BIT
R/W
SYMBOL
OPERATION (if bit is set)
RST = 0
RSTx = 0
(1)
0
1
2
3
4
5
6
7
8
9
10
11
12
13
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
PDRX1
PDRX2
NPDTX2
PDSYN
TXKEY1
TXKEY2
RXON
TXON
BEN
GPON1
GPON2
REFON
DSPON
NREFON
Enable line has default polarity if its corresponding bit
is a logic 0. Enable line has inverse default polarity if its
corresponding bit is a logic 1.
0
0
0
0
0
0
0
0
0
0
0
0
0
0
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