參數(shù)資料
型號(hào)： ORT8850L-3BM680C
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 54/105頁
文件大小： 0K
描述： IC FPSC TRANSCEIVER 8CH 680-BGA
產(chǎn)品變化通告： Product Discontinuation 01/Aug/2011
標(biāo)準(zhǔn)包裝： 24
系列： *
Lattice Semiconductor
ORCA ORT8850 Data Sheet
52
In the case shown in Figure 28 the alignment FIFO is used and all timing is with respect to the single reference
clock, which is routed through the FPGA as a primary clock. The capturing clock edge occurs after the launch of
the next data byte, so hold time margin is of concern and an acceptably margin should be veried. Launched data
has nearly a full clock period to become stable at the capture latch, so setup margin should not be a problem. Mov-
ing the capture to the rising clock edge might give a setup time margin problem.
Figure 28. Half Cycle, Alignment Mode Output Conguration and Timing (-1 Speed Grade)
D
+
Q
-
ΔΔΔΔ t
DOUTxx[7:0]
Note: xx = [AA, AB, ... BD]
Embedded
Core
FPGA
Logic
3.0 ns
Primary Clock
1.4 ns
ASB_CLK
a.) Configuration
FPGA_CLK
FPGA_SYSCLK
FPGA_SYSCLK
ASB_CLK
FPGA_CLK
Data Valid
DOUTxx[7:0]
-1.4
3.3
8.0
12.7
17.4
3.0
7.7
12.4
17.1
Hold
Capture
tprop_max = 2.4
tprop_min = - 0.8
b.) Timing (times in ns.)
Launch
0.0
4.7
9.4
14.1
18.8
相關(guān)PDF資料
PDF描述
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P1013PSE2EFA IC MPU PROTO 600MHZ 689-TEPBGA
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P1014NSN5FFA IC MPU 800MHZ 425TEPBGA1
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參數(shù)描述
ORT8850L-3BMN680C 功能描述:FPGA - 現(xiàn)場可編程門陣列 4992 LUT 278 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORT9303 制造商:BOT 制造商全稱:Bedford Opto Technology Ltd. 功能描述:3 ELEMENT PCB MOUNT 1.8mm LED ARRAY
ORT9303B 制造商:BOT 制造商全稱:Bedford Opto Technology Ltd. 功能描述:3 ELEMENT PCB MOUNT 1.8mm LED ARRAY
ORT9303BL 制造商:BOT 制造商全稱:Bedford Opto Technology Ltd. 功能描述:3 ELEMENT PCB MOUNT 1.8mm LED ARRAY
ORT9303G 制造商:BOT 制造商全稱:Bedford Opto Technology Ltd. 功能描述:3 ELEMENT PCB MOUNT 1.8mm LED ARRAY
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