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參數資料
| 型號： | GS1582-IBE3 |
| 廠商： | Gennum Corporation |
| 英文描述： | IC,MOT,MC145026P, DIP-16, ENCODER 9 LINE SIMPLEX |
| 中文描述： | 多速率的電纜驅動器，音頻多路復用器和ClockCleaner⑩串行 |
| 文件頁數： | 29/114頁 |
| 文件大?。?/td> | 1224K |
| 代理商： | GS1582-IBE3 |
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GS1582 Data Sheet
40117 - 1 November 2007
29 of 114
Figure 4-2: H_Blanking, V_Blanking, F_Digital Timing
4.3.2 CEA 861 Timing
The GS1582 extracts timing information from externally provided HSYNC, VSYNC,
and DE signals when CEA 861 timing mode is selected by setting DETECT_TRS
= LOW and the TIM_861 = HIGH.
H_Blanking: V_Blanking: F_Digital TIMING - HD 20-BIT INPUT MODE
PCLK
LUMA DATA OUT
CHROMA DATA OUT
H
XYZ
000
000
3FF
XYZ
000
000
3FF
V
F
XYZ
000
000
3FF
XYZ
000
000
3FF
H_Blanking: V_Blanking: F_Digital TIMING AT SAV - HD 10-BIT INPUT MODE
000
000
3FF
3FF
XYZ
000
000
XYZ
PCLK
H
V
F
H_Blanking: V_Blanking: F_Digital TIMING AT EAV - HD 10-BIT INPUT MODE
PCLK
000
000
3FF
3FF
XYZ
000
000
XYZ
MULTIPLEXED
Y/Cr/Cb DATA OUT
H
V
F
MULTIPLEXED
Y/Cr/Cb DATA OUT
H_Blanking: V_Blanking: F_Digital TIMING - SD 20-BIT INPUT MODE
PCLK
CHROMA DATA OUT
LUMA DATA OUT
H
000
3FF
XYZ
000
V
F
000
3FF
(XYZ
000
H_Blanking: V_Blanking: F_Digital TIMING - SD 10-BIT INPUT MODE
MULTIPLEXED
Y/Cr/Cb DATA OUT
PCLK
H
V
F
XYZ
000
000
3FF
XYZ
000
000
3FF
H SIGNAL TIMING:
H_CONFIG = LOW
H_CONFIG = HIGH
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PDF描述 |
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參數描述 |
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