19-4750; Rev 1; 07/11 145 of 194 Pn. Field Name Addr (A:) Bit [x:y] Type Description DBVSE [14] rwc-_-_ D Bit Va" />
參數(shù)資料
型號(hào)： DS34S132GN+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 52/194頁(yè)
文件大?。?/td> 0K
描述： IC TDM OVER PACKET 676-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 40
功能： TDM-over-Packet（TDMoP）
接口： TDMoP
電路數(shù)： 1
電源電壓： 1.8V, 3.3V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 676-BGA
供應(yīng)商設(shè)備封裝： 676-PBGA（27x27）
包裝： 管件
其它名稱(chēng)： 90-34S13+2N0
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
145 of 194
Pn. Field
Name
Addr (A:)
Bit [x:y] Type
Description
DBVSE
[14] rwc-_-_
D Bit Value for SF to ESF. Sets the value of the D bit when mapping SF locally
to ESF at the destination.
LB
[13] rwc-_-_
L Bit. This sets the L bit value for all Bundles sourced by this port.
LBSS
[12] rwc-_-_
L Bit Source Select selects the L-bit source for all TXP Bundles for this T1/E1
port: 0 = PRCR1.LB value or 1 = L-bit programmed in each TXP Bundle header.
SPL
[11:1] rwc-_-_
SAT Payload Length. Set to the # bytes per packet payload (SAT mode only).
SPL must = PMS and must be ≥ BPF. For example for T1 SAT, SPL = PMS =
0x17 (for 24 timeslots) and BPF must be set to 0x17 or less.
RSVD
[0]
Reserved.
PRCR2.
A:2044h
Port Receive Configuration Register 2. Default: 00.00.00.08h
RSVD
[31:7]
Reserved.
RSTS
[6] rwc-_-_
Receive Frame Synchronization .
0 = synchronized to RSYNC signal input
1 = synchronized to internal TDM Port Transmit frame timing (system timing)
RDS
[5] rwc-_-_
RSYNC Direction Select. This bit selects the direction of the RSYNC signal.
0 = input
1 = output
RSVD
[4]
Reserved.
RIES
[3] rwc-_-_
Receive Input Edge Select. This bit selects the edge to be used for port receive
data capture on inputs relative to RCLK.
0 = positive edge
1 = negative edge
RSVD
[2:1]
Reserved.
RSS
[0] rwc-_-_
RCLK Source Select. This bit is used to select the source of the clock used to
time the port receive interface. This selects the source clock for capture of RDAT,
RSIG, and RSYNC.
0 = RCLK Signal input
1 = TCLKO Signal output
PRCR3.
A:2048h
Port Receive Configuration Register 3. Default: 0x00.00.00.00
PTPRTSL
[31:0] rwc-_-_
PT to PR Time Slot Loopback. Each bit selects the TDM loopback for the
corresponding time slot from the port transmit to the port receive; bit 0 enables
port loop back for time slot 0, bit 1 enables port loop back for time slot 1, etc. You
may use either the loopback for PR to PT or PT to PR, but not both at the same
time; i.e. the control for the unused direction must not have any timeslots selected
for loopback. Note that for T1, bits 31:24 are not used.
PRCR4.
A:204Ch
Port Receive Configuration Register 4. Default: 0x00.00.00.00
RSVD
[31:17]
Reserved.
TSGMS
[16] rwc-_-_
RTP Time Stamp Generator Mode Select.
0 = derived from CMNCLK (Differential Timestamp)
1 = derived from RSS selected receive TDM Port timing (Absolute Timestamp)
TSGMC
[15:0] rwc-_-_
Timestamp Generator M Coefficient is defined by the following equation where
TSPCLK = “remote PW Timestamp clock rate” (TSPCLK and CMNCLK are
specified in bits/sec; only valid for TSGMS = 0). In most applications TSPCLK =
CMNCLK and TSGMC = 4096 decimal = 0x1000.
TSGMC = Integer [4096 * (TSPCLK ÷ CMNCLK)]
PRCR5.
A:2050h
Port Receive Configuration Register 5. Default: 0x00.00.00.00
RSVD
[31:29]
Reserved.
TSGN1C
[28:16] rwc-_-_
Timestamp Generator N1 Coefficient is defined by the following equation (see
TSGMC). In most applications TSPCLK = CMNCLK and TSGN1C = 0x0000.
TSGN1C = (CMNCLK ÷ 8000) * [TSGMC – 4096 * (TSPCLK ÷ CMNCLK)]
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PDF描述
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