19-4750; Rev 1; 07/11 62 of 194 9.3.3.1 TXP SAT/CES/HDLC/Clock Only PW Packet Generation A TXP Header Descriptor" />
參數(shù)資料
型號: DS34S132GN+
廠商: Maxim Integrated Products
文件頁數(shù): 154/194頁
文件大?。?/td> 0K
描述: IC TDM OVER PACKET 676-BGA
產(chǎn)品培訓模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝: 40
功能: TDM-over-Packet(TDMoP)
接口: TDMoP
電路數(shù): 1
電源電壓: 1.8V, 3.3V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 676-BGA
供應(yīng)商設(shè)備封裝: 676-PBGA(27x27)
包裝: 管件
其它名稱: 90-34S13+2N0
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
62 of 194
9.3.3.1 TXP SAT/CES/HDLC/Clock Only PW Packet Generation
A TXP Header Descriptor is programmed for each activated SAT, CES, HDLC and Clock Only Bundle (up to 256).
The TXP Header Descriptors are retrieved from memory as they are needed for each outgoing TXP PW Packet.
Figure 9-25 depicts the format of the data that is programmed in the TXP Header Descriptor. The Header Control is
used to identify the number of bytes included in the transmitted TXP Header and where the TXP Local Timestamp,
Length and FCS fields are located in the header so that the S132 can modify these fields “on-the-fly” when
required. The Header Control field values are not included in the transmitted Ethernet packets.
Figure 9-25. SAT/CES/HDLC/Clock Only PW TXP Header Descriptor
3
1
3
0
2
9
2
8
2
7
2
6
2
5
2
4
2
3
2
1
2
0
1
9
1
8
1
7
1
6
1
5
1
4
1
3
1
2
1
0 9 8 7 6 5 4 3 2 1 0
Header Control
2-bytes of Dummy Fill = 0x00.00
Ethernet Header including …
… DA, SA, optional VLAN Tags, optional LLC/SNAP and Type/Length fields
Application Protocol Header (e.g. UDP/IP, L2TPv3/IP, MFA-8, MEF-8)
Optional RTP and Control Word Headers
The 256 TXP Header Descriptors are programmed in an SDRAM memory block that begins at address
EMI.BMCR1.TXHSO. The TXP Header Descriptor for each Bundle is stored in a 128-byte SDRAM slot that is
addressed/indexed at the location = TXHXSO + (Bundle Number * 128 bytes).
The TXP Header Control for SAT/CES and HDLC PW packets is a 32-bit Dword (depicted in Table 9-11.
Table 9-11. TXP SAT/CES/HDLC/Clock Only PW Header Control
Field
Bit [x:y] Description
RSVD
[31:26]
Reserved.
TXELEN [25:21]
TXP Header Length specifies how many Dwords are in the packet header including the
Ethernet, Application, RTP and Control Word Headers (when applicable).
TXCWE [20]
TXP Control Word Exists. 1 = included; 0 = not included.
TXRE
[19]
TXP RTP Exists. 1 = included; 0 = not included.
RSVD
[18:16]
Reserved.
TXALEN [15:11]
TXP Application Header Length specifies how many Dwords are included in the
Application Protocol Header beginning just after the Ethernet Header and including the
Control Word and RTP Headers (when applicable).
TXAOFF [10:6]
TXP Application Header Offset = Dword offset of Application Header in Ethernet packet.
TXAOFF = (“Application Header starting byte position in Ethernet packet” - 2) ÷ 4
TXUDPE [5]
TXP UDP Header Exists. 1 = included; 0 = not included.
TXIPV6E [4]
TXP IPv6 Header Exists. 1 = included; 0 = not included.
TXIPV4E [3]
TXP IPv4 Header Exists. 1 = included; 0 = not included.
TXVLTC [2:1]
TXP VLAN Tag Count specifies # VLAN tags in the header (valid values = 0, 1 or 2).
TXETHF [0]
TXP Ethernet Header Format. 0 = DIX/Ethernet II format; 1 = IEEE 802.2 LLC/SNAP.
The S132 automatically generates TXP SAT/CES/Clock Only packets when sufficient data has been received from
the TDM Port to satisfy the B.BCDR1.PMS (effective payload size) and B.BCDR3.TXBTS (payload type) settings.
All SAT/CES/Clock Only Bundles must be assigned at least one Timeslot (B.BCDR2.ATSS and TSAn.m).
B.BCDR3.TXPMS selects whether the packet stream for the TXP Bundle is disabled, transmitted without payload
(Clock Only) or transmitted with payload (normal).
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PDF描述
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