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參數(shù)資料
| 型號： | DS34S132GN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 18/194頁 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 電路數(shù)： | 1 |
| 電源電壓： | 1.8V, 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 676-BGA |
| 供應(yīng)商設(shè)備封裝： | 676-PBGA（27x27） |
| 包裝： | 管件 |
| 其它名稱： | 90-34S13+2N0 |
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
114 of 194
PC. Field
Name
Addr (A:)
Bit [x:y] Type
Description
UPVCSL
[6] rls-crw-i3
UDP Port Value Check Status Latch = “1” indicates 1 or more RXP UDP
packets have been received with a BID or OAM BID match, but with a UDP
Protocol Type mismatch (2 UDP Protocol values can be recognized:
PC.CR2.UPVC1 and PC.CR2.UPVC2).
UBIDLCS
L
[5] rls-crw-i3
UDP Bundle ID Location Check Status Latch = “1” indicates 1 or more RXP
UDP packets have been received with a BID match found, but not in the location
specified by Bundle parameter B.BCDR4.RXUBIDLS .
BIDMSL
[4] rls-crw-i3
Bundle ID Mismatch Status Latch = “1” indicates 1 or more RXP packets with
any of the PW headers has been received with a PW-ID that did not match any of
the active BIDs or OAM BIDs (indicates when an unknown PW-ID is received).
RXPFOSL
[3] rls-crw-i3
Reserved.
RXPMES
L
[2] rls-crw-i3
RXP Packet MPLS Error Status Latch = “1” indicates 1 or more RXP MPLS
packets have been received with a header that included more than 3 Labels.
ICPESL
[1] rls-crw-i3
IP Checksum Packet Error Status Latch = “1” indicates 1 or more RXP IPv4
packets have been received with an IPv4 checksum error.
UCPESL
[0] rls-crw-i3
UDP Checksum Packet Error Status Latch = “1” indicates 1 or more RXP UDP
packets have been received with a UDP checksum error (IPv4 or IPv6).
10.3.4.3 Packet Classifier Status Register Interrupt Enables (PC.)
Table 10-15. Packet Classifier Status Register Interrupt Enables (PC.)
PC. Field
Name
Addr (A:)
Bit [x:y] Type
Description
SRIE.
A:0368h
Status Register Interrupt Enable. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
VMDIE
[7] rwc-_-i3
VLAN Mismatch Discard Interrupt Enable = “1” enables an interrupt (INT_N)
and forces G.GSR1.PCS = 1 when PC.SRL.VMDSL = “1”.
UPVCIE
[6] rwc-_-i3
UDP Port Value Check Interrupt Enable = “1” enables an interrupt (INT_N) and
forces G.GSR1.PCS = 1 when PC.SRL.UPVCSL = “1”.
UBIDLCI
E
[5] rwc-_-i3
UDP Bundle ID Location Check Interrupt Enable = “1” enables an interrupt
(INT_N) and forces G.GSR1.PCS = 1 when PC.SRL.UBIDLCSL = “1”.
RXPMIE
[4] rwc-_-i3
RXP Packet Mismatch Interrupt Enable = “1” enables an interrupt (INT_N) and
forces G.GSR1.PCS = 1 when PC.SRL.BIDMSL = “1”.
RXPFOSIE
[3] rwc-_-i3
Reserved.
RXPMEIE
[2] rwc-_-i3
RXP Packet MPLS Error Interrupt Enable = “1” enables an interrupt (INT_N)
and forces G.GSR1.PCS = 1 when PC.SRL.RXPMESL = “1”.
ICPEIE
[1] rwc-_-i3
IP Checksum Packet Error Interrupt Enable = “1” enables an interrupt (INT_N)
and forces G.GSR1.PCS = 1 when PC.SRL.ICPESL = “1”.
UCPEIE
[0] rwc-_-i3
UDP Checksum Packet Error Interrupt Enable = “1” enables an interrupt
(INT_N) and forces G.GSR1.PCS = 1 when PC.SRL.IUCPESL = “1”.
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