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參數(shù)資料
| 型號： | DS34S132GN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 21/194頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 電路數(shù)： | 1 |
| 電源電壓： | 1.8V, 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 676-BGA |
| 供應商設備封裝： | 676-PBGA（27x27） |
| 包裝： | 管件 |
| 其它名稱： | 90-34S13+2N0 |
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
117 of 194
EMI. Field
Name
Addr (A:)
Bit [x:y] Type
Description
ETRCSL
[4] rls-crw-i3
Ethernet to TDM Read Check Status Latch = “1” indicates one or more SDRAM
Read operations were invalid due to EMI.BMCR2.JBSO. The Jitter Buffer Queues
overlap with another SDRAM queue due to an invalid EMI Start Address setting.
The combination of ETRCSL = 1 and ETRCIE = 1 forces G.GSR1.EMIS = 1.
ETWCSL
[3] rls-crw-i3
Ethernet to TDM Write Check Status Latch = “1” indicates 1 or more SDRAM
Write operations were invalid due to EMI.BMCR2.JBSO. The Jitter Buffer Queues
overlap with another SDRAM queue due to an invalid EMI Start Address setting.
The combination of ETWCSL = 1 and ETWCIE = 1 forces G.GSR1.EMIS = 1.
TXPSRCS
L
[2] rls-crw-i3
TXP Packet Space Read Check Status Latch = “1” indicates 1 or more SDRAM
Read operations were invalid due to EMI.BMCR1.TXPSO. The TXP TDM Packet
Queues overlap with another queue due to an invalid EMI Start Address. The
combination of TXPSRCSL = 1 and TXPSRCIE = 1 forces G.GSR1.EMIS = 1.
TXPSWC
SL
[1] rls-crw-i3
TXP Packet Space Write Check Status Latch = “1” indicates 1 or more SDRAM
Write operations were invalid due to EMI.BMCR1.TXPSO. The TXP TDM Packet
Queues overlap with another queue due to an invalid EMI Start Address. The
combination of TXPSWCSL = 1 and TXPSWCIE = 1 forces G.GSR1.EMIS = 1.
TXHSRCS
L
[0] rls-crw-i3
TXP Header Space Read Check Status Latch = “1” indicates 1 or more SDRAM
Read operations were invalid due to EMI.BMCR1.TXHSO. The TXP TDM Header
space overlaps with another queue due to an invalid EMI Start Address. The
combination of TXHSRCSL = 1 and TXHSRCIE = 1 forces G.GSR1.EMIS = 1.
10.3.5.3 External Memory Interface Status Register Interrupt Enables (EMI.)
Table 10-19. External Memory Interface Status Register Interrupt Enables (EMI.)
EMI. Field
Name
Addr (A:)
Bit [x:y] Type
Description
BMSRIE. A:03B0h
Buffer Manager Status Register Interrupt Enable. Default: 0x00.00.00.00
RSVD
[31:9]
Reserved.
CERCIE
[8] rwc-_-i3
CPU to Ethernet Read Check Interrupt Enable. (see EMI.BMSRL.CERCSL)
CEWCIE
[7] rwc-_-i3
CPU to Ethernet Write Check Interrupt Enable. (see EMI.BMSRL.CEWCSL)
ECRCIE
[6] rwc-_-i3
Ethernet to CPU Read Check Interrupt Enable. (see EMI.BMSRL.ECRCSL)
ECWCIE
[5] rwc-_-i3
Ethernet to CPU Write Check Interrupt Enable. (see EMI.BMSRL.ECWCSL)
ETRCIE
[4] rwc-_-i3
Ethernet to TDM Read Check Interrupt Enable. (see EMI.BMSRL.ETRCSL)
ETWCIE
[3] rwc-_-i3
Ethernet to TDM Write Check Interrupt Enable. (see EMI.BMSRL.ETWCSL)
TXPSRCI
E
[2] rwc-_-i3
TXP Packet Space Read Check Interrupt Enable. (see EMI.BMSRL.TXPSRSL)
TXPSWCI
E
[1] rwc-_-i3
TXP Packet Space Write Check Interrupt Enable. (see
EMI.BMSRL.TXPSWCSL)
TXHSRCI
E
[0] rwc-_-i3
TXP Header Space Read Check Interrupt Enable. (see
EMI.BMSRL.TXHSRCSL)
TSRL
A:03B4h
Test Status Register Latched
RSVD
[31:11]
Reserved.
EMARER
RSL
[10] rls-crw-_
Reserved.
EMAWER
RSL
[9] rls-crw-_
Reserved.
RPIRERR
SL
[8] rls-crw-_
Reserved.
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| DS34T101_08 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_09 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
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