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參數(shù)資料
| 型號： | AM8530H |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | Serial Communications Controller |
| 中文描述： | 串行通信控制器 |
| 文件頁數(shù)： | 155/194頁 |
| 文件大?。?/td> | 797K |
| 代理商： | AM8530H |
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SCC Application Notes
AMD
7–6
Table 7–2. SCC Initialization Order
Part 1. Modes and Constants
1100000
Hardware Reset
XXXXXXXX Tx/Rx con, Aysnc or Sync Mode
0XX00X00 Select W/REQ (opt)
XXXXXXXX Program Interrupt Vector (opt)
XXXXXXX0 Select Rx Control
XXXX0XXX Select Tx Control
XXXXXXXX Program sync character (opt)
XXXXXXXX Program sync character (opt)
000X0XXX Select Interrupt Control
XXXXXXXX Miscellaneous Control (opt)
XXXXXXXX Clock Control
XXXXXXXX Time constant lower byte (opt)
XXXXXXXX Time constant upper byte (opt)
XXXXXXX0 Miscellaneous Control
XXXSSSSSCommands (opt)
Part 2. Enables
000SSSS1 Baud Rate Enable
SSSSSSS1Rx Enable
SSSS1SSSTx Enable
10000000
Reset Tx CRG (opt)
XSS00S00 DMA Enable (opt)
Part 3. Interrupt Status
XXXXXXXX Enable External/Status
00010000
Reset External Status
00010000
Reset External Status twice
SSSXXSXX Enable Rx, Tx and Ext/Status
000SXSSS Enable Master Interrupt Enable
1 = Set to one
X = User defined
0 = Reset to zero
S = Same as previously
prog.
WR9
WR4
WR1
WR2
WR3
WR5
WR6
WR7
WR9
WR10
WR11
WR12
WR13
WR14
WR14
WR14
WR3
WR5
WR0
WR1
WR15
WR0
WR0
WR1
WR9
7.1.1.3
Table 7–1 as shown previously, is a worksheet for the initialization of the SCC. All the bits
that must be programmed as either a ‘0’ or a ‘1’ are already filled in; the remaining bits
are left blank and are to be programmed by the user according to the desired mode of
operation. The binary value can then be converted to a hexadecimal number and placed
in the table, following the Write register notation in the column labeled “HEX.” A Program
Initialization Table is produced when this worksheet is completed.
Initialization T able Generation
7.1.1.4
Prior to initialization, the SCC should be reset by either hardware or software. A hardware
reset can be accomplished by simultaneously grounding RD and WR. A software reset
can be executed by writing a C0H to Write Register 9. After one channel has been initial-
ized, a channel reset should be used in place of the hardware reset in the initialization.
The state of the SCC registers, after reset, is shown in Table 7–3. Before writing to the
SCC, a read should be performed to guarantee the internal logic is pointing to Register 0.
Reset Conditions
相關PDF資料 |
PDF描述 |
|---|---|
| AM85C30-10PC | Enhanced Serial Communications Controller |
| Am85C30 | Serial Communications Controller |
| AM85C30 | Enhanced Serial Communications Controller |
| AM85C30-8PC | Enhanced Serial Communications Controller |
| AM85C30-16JC | Enhanced Serial Communications Controller |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| AM8530H/AM85C301992 | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Am8530H/Am85C30 1992 - Am8530H/Am85C30 Serial Communications Controller |
| AM8530H-4DC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| AM8530H-4DCB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| AM8530H-4JC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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