- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄368739 > 18F258 (Microchip Technology Inc.) 28/40/44-Pin Enhanced Flash Microcontrollers with ECAN Technology, 10-Bit A/D and nanoWatt Technology PDF資料下載
參數(shù)資料
| 型號(hào)： | 18F258 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 28/40/44-Pin Enhanced Flash Microcontrollers with ECAN Technology, 10-Bit A/D and nanoWatt Technology |
| 中文描述： | 28/40/44-Pin增強(qiáng)型閃存微控制器與ECAN技術(shù)，10位A / D和納瓦技術(shù) |
| 文件頁(yè)數(shù)： | 396/484頁(yè) |
| 文件大小： | 8617K |
| 代理商： | 18F258 |
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PIC18F2480/2580/4480/4580
DS39637A-page 394
Preliminary
2004 Microchip Technology Inc.
RLNCF
Example:
RRCF
Example:
Rotate Left f (No Carry)
Syntax:
RLNCF f {,d {,a}}
Operands:
0
≤
f
≤
255
d
∈
[0,1]
a
∈
[0,1]
(f<n>)
→
dest<n + 1>,
(f<7>)
→
dest<0>
Operation:
Status Affected:
N, Z
Encoding:
0100
01da
ffff
ffff
Description:
The contents of register ‘f’ are rotated
one bit to the left. If ‘d’ is ‘
0
’, the result
is placed in W. If ‘d’ is ‘
1
’, the result is
stored back in register ‘f’ (default).
If ‘a(chǎn)’ is ‘
0
’, the Access Bank is selected.
If ‘a(chǎn)’ is ‘
1
’, the BSR is used to select the
GPR bank (default).
If ‘a(chǎn)’ is ‘
0
’ and the extended instruction
set is enabled, this instruction operates
in Indexed Literal Offset Addressing
mode whenever f
≤
95 (5Fh). See
Section 25.2.3 “Byte-Oriented and
Bit-Oriented Instructions in Indexed
Literal Offset Mode”
for details.
Words:
1
Cycles:
1
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Read
register ‘f’
Process
Data
Write to
destination
RLNCF
REG, 1, 0
Before Instruction
REG
After Instruction
REG
=
1010 1011
=
0101 0111
register f
Rotate Right f through Carry
Syntax:
RRCF f {,d {,a}}
Operands:
0
≤
f
≤
255
d
∈
[0,1]
a
∈
[0,1]
(f<n>)
→
dest<n – 1>,
(f<0>)
→
C,
(C)
→
dest<7>
Operation:
Status Affected:
C, N, Z
Encoding:
0011
00da
ffff
ffff
Description:
The contents of register ‘f’ are rotated
one bit to the right through the Carry
flag. If ‘d’ is ‘
0
’, the result is placed in W.
If ‘d’ is ‘
1
’, the result is placed back in
register ‘f’ (default).
If ‘a(chǎn)’ is ‘
0
’, the Access Bank is selected.
If ‘a(chǎn)’ is ‘
1
’, the BSR is used to select the
GPR bank (default).
If ‘a(chǎn)’ is ‘
0
’ and the extended instruction
set is enabled, this instruction operates
in Indexed Literal Offset Addressing
mode whenever f
≤
95 (5Fh). See
Section 25.2.3 “Byte-Oriented and
Bit-Oriented Instructions in Indexed
Literal Offset Mode”
for details.
Words:
1
Cycles:
1
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Read
register ‘f’
Process
Data
Write to
destination
RRCF
REG, 0, 0
Before Instruction
REG
C
After Instruction
REG
W
C
=
=
1110 0110
0
=
=
=
1110 0110
0111 0011
0
C
register f
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