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參數(shù)資料
| 型號(hào)： | 18F258 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 28/40/44-Pin Enhanced Flash Microcontrollers with ECAN Technology, 10-Bit A/D and nanoWatt Technology |
| 中文描述： | 28/40/44-Pin增強(qiáng)型閃存微控制器與ECAN技術(shù)，10位A / D和納瓦技術(shù) |
| 文件頁(yè)數(shù)： | 360/484頁(yè) |
| 文件大?。?/td> | 8617K |
| 代理商： | 18F258 |
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PIC18F2480/2580/4480/4580
DS39637A-page 358
Preliminary
2004 Microchip Technology Inc.
TABLE 24-3:
SUMMARY OF CODE PROTECTION REGISTERS
24.5.1
PROGRAM MEMORY
CODE PROTECTION
The program memory may be read to or written from
any location using the table read and table write
instructions. The device ID may be read with table
reads. The configuration registers may be read and
written with the table read and table write instructions.
In normal execution mode, the CPn bits have no direct
effect. CPn bits inhibit external reads and writes. A
block of user memory may be protected from table
writes if the WRTn configuration bit is ‘
0
’. The EBTRn
bits control table reads. For a block of user memory
with the EBTRn bit set to ‘
0
’, a table read instruction
that executes from within that block is allowed to read.
A table read instruction that executes from a location
outside of that block is not allowed to read and will
result in reading ‘
0
’s. Figures 24-6 through 24-8
illustrate table write and table read protection.
FIGURE 24-6:
TABLE WRITE (WRTn) DISALLOWED
File Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
300008h
300009h
30000Ah
30000Bh
30000Ch
30000Dh
Legend:
CONFIG5L
CONFIG5H
CONFIG6L
CONFIG6H
CONFIG7L
CONFIG7H
Shaded cells are unimplemented.
Unimplemented in PIC18FX480 devices; maintain this bit set.
—
—
—
—
—
—
—
—
—
—
—
CP3*
—
WRT3*
—
EBTR3*
—
CP2
—
WRT2
—
EBTR2
—
CP1
—
WRT1
—
EBTR1
—
CP0
—
WRT0
—
EBTR0
—
CPD
—
WRTD
—
—
CPB
—
WRTB
—
EBTRB
WRTC
—
—
*
Note:
Code protection bits may only be written to
a ‘
0
’ from a ‘
1
’ state. It is not possible to
write a ‘
1
’ to a bit in the ‘
0
’ state. Code
protection bits are only set to ‘
1
’ by a full
chip erase or block erase function. The full
chip erase and block erase functions can
only be initiated via ICSP or an external
programmer.
000000h
0007FFh
000800h
003FFFh
004000h
007FFFh
008000h
00BFFFh
00C000h
00FFFFh
WRTB, EBTRB =
11
WRT0, EBTR0 =
01
WRT1, EBTR1 =
11
WRT2, EBTR2 =
11
WRT3, EBTR3 =
11
TBLWT*
TBLPTR = 0008FFh
PC = 003FFEh
TBLWT*
PC = 00BFFEh
Register Values
Program Memory
Configuration Bit Settings
Results:
All table writes disabled to Blockn whenever WRTn =
0
.
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