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參數(shù)資料
| 型號： | 18F258 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 28/40/44-Pin Enhanced Flash Microcontrollers with ECAN Technology, 10-Bit A/D and nanoWatt Technology |
| 中文描述： | 28/40/44-Pin增強型閃存微控制器與ECAN技術(shù)，10位A / D和納瓦技術(shù) |
| 文件頁數(shù)： | 233/484頁 |
| 文件大?。?/td> | 8617K |
| 代理商： | 18F258 |
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2004 Microchip Technology Inc.
Preliminary
DS39637A-page 231
PIC18F2480/2580/4480/4580
18.1
Baud Rate Generator (BRG)
The BRG is a dedicated 8-bit or 16-bit generator that
supports both the Asynchronous and Synchronous
modes of the EUSART. By default, the BRG operates
in 8-bit mode; setting the BRG16 bit (BAUDCON<3>)
selects 16-bit mode.
The SPBRGH:SPBRG register pair controls the period
of a free running timer. In Asynchronous mode, bits
BRGH (TXSTA<2>) and BRG16 (BAUDCON<3>) also
control the baud rate. In Synchronous mode, BRGH is
ignored. Table 18-1 shows the formula for computation
of the baud rate for different EUSART modes which
only apply in Master mode (internally generated clock).
Given the desired baud rate and F
OSC
, the nearest
integer value for the SPBRGH:SPBRG registers can be
calculated using the formulas in Table 18-1. From this,
the error in baud rate can be determined. An example
calculation is shown in Example 18-1. Typical baud
rates and error values for the various Asynchronous
modes are shown in Table 18-2. It may be advanta-
geous to use the high baud rate (BRGH =
1
) or the
16-bit BRG to reduce the baud rate error, or achieve a
slow baud rate for a fast oscillator frequency.
Writing a new value to the SPBRGH:SPBRG registers
causes the BRG timer to be reset (or cleared). This
ensures the BRG does not wait for a timer overflow
before outputting the new baud rate.
18.1.1
OPERATION IN POWER MANAGED
MODES
The device clock is used to generate the desired baud
rate. When one of the power managed modes is
entered, the new clock source may be operating at a
different frequency. This may require an adjustment to
the value in the SPBRG register pair.
18.1.2
SAMPLING
The data on the RX pin is sampled three times by a
majority detect circuit to determine if a high or a low
level is present at the RX pin.
TABLE 18-1:
BAUD RATE FORMULAS
Configuration Bits
BRG16
EXAMPLE 18-1:
For a device with F
OSC
of 16 MHz, desired baud rate of 9600, Asynchronous mode, 8-bit BRG:
Desired Baud Rate
= F
OSC
/(64 ([SPBRGH:SPBRG] + 1)
Solving for SPBRGH:SPBRG:
X
=
((F
OSC
/Desired Baud Rate)/64) – 1
=
((16000000/9600)/64) – 1
=
[25.042] = 25
Calculated Baud Rate
=
16000000/(64 (25 + 1))
=
9615
Error
=
(Calculated Baud Rate – Desired Baud Rate)/Desired Baud Rate
=
(9615 – 9600)/9600 = 0.16%
CALCULATING BAUD RATE ERROR
TABLE 18-2:
REGISTERS ASSOCIATED WITH BAUD RATE GENERATOR
BRG/EUSART Mode
Baud Rate Formula
SYNC
BRGH
0
0
0
0
1
1
0
0
1
1
0
1
0
1
0
1
x
x
8-bit/Asynchronous
8-bit/Asynchronous
16-bit/Asynchronous
16-bit/Asynchronous
8-bit/Synchronous
16-bit/Synchronous
F
OSC
/[64 (n + 1)]
F
OSC
/[16 (n + 1)]
F
OSC
/[4 (n + 1)]
Legend:
x
= Don’t care, n = value of SPBRGH:SPBRG register pair
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset
Values
on page
TXSTA
RCSTA
BAUDCON
SPBRGH
SPBRG
Legend:
CSRC
SPEN
ABDOVF
EUSART Baud Rate Generator Register High Byte
EUSART Baud Rate Generator Register Low Byte
— = unimplemented, read as ‘
0
’. Shaded cells are not used by the BRG.
TX9
RX9
RCIDL
TXEN
SREN
—
SYNC
CREN
SCKP
SENDB
ADDEN
BRG16
BRGH
FERR
—
TRMT
OERR
WUE
TX9D
RX9D
ABDEN
51
51
51
51
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