參數(shù)資料
型號(hào)： W948D6FBHX6G
廠商： WINBOND ELECTRONICS CORP
元件分類： DRAM
英文描述： 8M X 16 DDR DRAM, 5 ns, PBGA60
封裝： 8 X 9 MM, 0.80 MM PITCH, HALOGEN FREE AND LEAD FREE, VFBGA-60
文件頁(yè)數(shù)： 10/60頁(yè)
文件大?。?/td> 1147K
代理商： W948D6FBHX6G
W948D6FB / W948D2FB
256Mb Mobile LPDDR
Publication Release Date : May, 24, 2011
- 18 -
Revision A01-003
6.7.2 Status Register Read Timing Diagram
CMD
NOP
MRS
READ
CL=3
0
0 1
tRP
tSRR
tSRC
DQ:Reg out
=Don’t Care
PCHA, or PCH
CK
Command
BA1,BA0
An – A0
DQS
DQ
Notes :
1.SRR can only be issued after power-up sequence is complete.
2.SRR can only be issued with all banks precharged.
3.SRR CL is unchanged from value in the mode register.
4.SRR BL is fixed at 2.
5.tSRR = 2 (min).
6.tSRC = CL + 1; (min time between read to next valid command)
7.No commands other than NOP and DES are allowed between the SRR and the READ.
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PDF描述
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