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參數(shù)資料
| 型號(hào)： | UPD70F3271GF-3BA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 46/827頁 |
| 文件大?。?/td> | 4275K |
| 代理商： | UPD70F3271GF-3BA |
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Preliminary User’s Manual U16541EJ1V0UM
14
18.1.3
Communication mode..............................................................................................................516
18.1.4
Communication address ..........................................................................................................516
18.1.5
Broadcast communication .......................................................................................................517
18.1.6
Transfer format of IEBus .........................................................................................................517
18.1.7
Transfer data ...........................................................................................................................527
18.1.8
Bit format .................................................................................................................................529
18.2
Configuration .........................................................................................................................530
18.3
Control Registers...................................................................................................................532
18.4
Interrupt Operations of IEBus Controller ............................................................................562
18.4.1
Interrupt control block ..............................................................................................................562
18.4.2
Example of identifying interrupt ...............................................................................................564
18.4.3
Interrupt source list ..................................................................................................................567
18.4.4
Communication error source processing list ...........................................................................568
18.5
Interrupt Request Signal Generation Timing and Main CPU Processing ........................570
18.5.1
Master transmission ................................................................................................................570
18.5.2
Master reception......................................................................................................................572
18.5.3
Slave transmission ..................................................................................................................574
18.5.4
Slave reception........................................................................................................................576
18.5.5
Interval of occurrence of interrupt request signal for IEBus control.........................................578
CHAPTER 19 CAN CONTROLLER.......................................................................................................582
19.1
Outline ....................................................................................................................................582
19.1.1
Features ..................................................................................................................................582
19.1.2
Overview of functions ..............................................................................................................583
19.1.3
Configuration ...........................................................................................................................584
19.2
CAN Protocol .........................................................................................................................585
19.2.1
Frame format ...........................................................................................................................585
19.2.2
Frame types.............................................................................................................................586
19.2.3
Data frame and remote frame..................................................................................................586
19.2.4
Error frame ..............................................................................................................................594
19.2.5
Overload frame ........................................................................................................................595
19.3
Functions................................................................................................................................596
19.3.1
Arbitration ................................................................................................................................596
19.3.2
Bit stuffing................................................................................................................................597
19.3.3
Multi masters ...........................................................................................................................597
19.3.4
Multi cast .................................................................................................................................597
19.3.5
Sleep mode/stop function ........................................................................................................597
19.3.6
Error control function ...............................................................................................................598
19.3.7
Baud rate control function........................................................................................................601
19.3.8
State transition chart................................................................................................................604
19.4
Connection with Target System ...........................................................................................607
19.5
Internal Registers of CAN Controller ...................................................................................608
19.5.1
CAN controller configuration....................................................................................................608
19.5.2
Register access type ...............................................................................................................609
19.5.3
Control bits of message buffers...............................................................................................626
19.6
Control Registers...................................................................................................................629
19.7
Bit Set/Clear Function ...........................................................................................................663
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PDF描述 |
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