參數(shù)資料
型號(hào)： TSB12LV01APZ
廠商： Texas Instruments, Inc.
英文描述： High-Speed Serial-Bus Link-Layer Controller
中文描述： 高速串行總線鏈路層控制器
文件頁(yè)數(shù)： 54/71頁(yè)
文件大?。?/td> 267K
代理商： TSB12LV01APZ
6–2
tsu3
BCLK
DATA0 –
DATA31
ADDR0 –
ADDR7
CA
WR
CS
tsu2
td3
td1
td4
NOTE A. Following a CS assertion, there may be a maximum of 9 rising edges of BCLK before a CA is returned. CA
must be returned before another CS may be asserted.
Figure 6–3. Host-Interface Read-Cycle Waveforms (Address: 00h – 2Ch)
BCLK
DATA0 – DATA31
ADDR0 – ADDR7
CA
WR
CS
tsu3
ADDR2
DATA2
tsu2
tsu4
td2
tsu1
th1
th2
th3
td1
ADDR1
DATA1
NOTE A. There must be a minimum of 3 rising edges of BCLK between assertions of CS.
Figure 6–4. Host-Interface Quick Write-Cycle Waveforms (ADDR0 – ADDR7
≥
30h)
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PDF描述
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參數(shù)描述
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