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參數(shù)資料
| 型號： | HMS30C7202 |
| 廠商： | HYNIX SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-bit ARM7TDMI RISC static CMOS CPU core |
| 中文描述： | 32-BIT, 82.944 MHz, RISC PROCESSOR, PBGA256 |
| 封裝： | 17 X 17 MM, 1.40 MM HEIGHT, 1 MM PITCH, FBGA-256 |
| 文件頁數(shù)： | 86/161頁 |
| 文件大小： | 973K |
| 代理商： | HMS30C7202 |
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HMS30C7110
2003 MagnaChip Semiconductor Ltd. All Rights Reserved
Version 1.5
86
18
RWC
0
READ
0 = no operation or read complete
1 = read operation is in progress
Setting ‘1’ will initiate read operation. It will be auto cleared if read
operation is completed. Data read from PHY will be stored at
MII_RXDATA (offset = 0x3C)
17
RWC
0
WRITE
0 = no operation or write complete
1 = write operation is in progress
Setting ‘1’ will initiate write operation. It will be auto cleared if write
operation is completed. Transmit data should be written in
MII_TXDATA (offset = 0x38) before setting this bit.
16
RW
0
Scan / setting ‘1’ will initiate a scan operation
0 = no operation or scan complete
1 = SCAN operation is in progress
Scan operation will perform read operation throughout the entire range
of PHY ID and register offsets. Interrupt will be generated (if enabled)
whenever single read is completed. The first PHY ID and register offsets
to start scan operation should be written in bits[12:8] and bits[4:0]
before setting this bit. The CPU needs to clear this bit to stop scan
operation.
15:13
0
Reserved
12:8
RW
0
PHY address
7:5
0
Reserved
4:0
RW
0
Register address in a PHY
2.6.2.15.
MII_TXDATA (offset = 0x38)
The CPU should write 16-bit TX data prior to send write command via MII_CMD register.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HMS30C7202N | Highly-intergrated MPU |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| HMS3224M3-12 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
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