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參數(shù)資料
| 型號： | HDMP-1024 |
| 英文描述： | Low Cost Gigabit Rate Receive Chip Set with TTL I/Os(帶TTL輸入/輸出的低價格千兆位速率接收芯片) |
| 中文描述： | 低成本千兆速率接收芯片組配備TTL的I / O（帶的TTL輸入/輸出的低價格千兆位速率接收芯片） |
| 文件頁數(shù)： | 40/40頁 |
| 文件大?。?/td> | 363K |
| 代理商： | HDMP-1024 |
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Figure 23. Methods of Interfacing O-BLL and I-H50.
Tx
Rx
50
50
Z
o
= 50
Tx
Rx
Z
o
= 50
Z
o
= 50
A) SINGLE-ENDED DRIVE
B) DIFFERENTIAL DRIVE
D
OUT+
D
OUT-
D
IN+
D
IN-
0.1 μF
D
OUT+
D
OUT-
D
IN+
D
IN-
0.1 μF
0.1 μF
0.1 μF
0.1 μF
Tx
Z
o
= 50
Z
o
= 50
R2
R1
C) DIFFERENTIAL DRIVE TO A PECL INPUT
D) SINGLE-ENDED DRIVE TO A PECL INPUT
D
OUT+
D
OUT-
V
CC+
Tx
Z
o
= 50
R2
R1
D
OUT+
D
OUT-
V
CC+
C
b
0.1 μF
0.1 μF
0.1 μF
C
b
V
BB
0.1 μF
50
PECL
PECL
E) DRIVING THE Rx INPUT FROM A PECL INPUT
PECL
Z
o
= 50
R
S
D
OUT+
D
OUT-
0.1 μF
R
S
D
IN+
D
IN-
0.1 μF
Z
o
= 50
Rx
www.semiconductor.agilent.com
Data subject to change.
Copyright 1999 Agilent Technologies, Inc.
Obsoletes 5965-9971E (6/97)
5966-1183E (11/99)
相關(guān)PDF資料 |
PDF描述 |
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