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參數(shù)資料
| 型號： | HDMP-1024 |
| 英文描述： | Low Cost Gigabit Rate Receive Chip Set with TTL I/Os(帶TTL輸入/輸出的低價格千兆位速率接收芯片) |
| 中文描述： | 低成本千兆速率接收芯片組配備TTL的I / O（帶的TTL輸入/輸出的低價格千兆位速率接收芯片） |
| 文件頁數(shù)： | 25/40頁 |
| 文件大?。?/td> | 363K |
| 代理商： | HDMP-1024 |
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25
HDMP-1022 (Tx), HDMP-1024 (Rx)
Control Frame Structure
M20SEL Not Asserted (16 bit mode)
D-Field
D7
0
1
C-Field
C1
0
1
D0 - D6
D
0
-
D
6
D
0
-
D
6
D8
1
0
D9 - D15
D
7
-
D
13
D
7
-
D
13
C0
0
1
C2
1
0
C3
1
0
Control Frame Structure
M20SEL Asserted (20 bit mode)
D-Field
D9
0
1
C-Field
C1
0
1
D0 - D8
D
0
-
D
8
D
0
-
D
8
D10
1
0
D11-D19
D
9
-
D
17
D
9
-
D
17
C0
0
1
C2
1
0
C3
1
0
occurring between C1 and C2.
Logical FF1 toggles between two
different physical codes, the first
of which advances the falling edge
of FF0 by one bit, the second of
which retards the falling edge of
FF0 by one bit. Two logical fill
frame types are required for link
start up in duplex mode.
Fill Frame Codes
Two logical fill frames are
provided: FF0 and FF1. FF0 is
physically a 50% duty cycle wave
form with its sole rising edge
Fill Frame Structure
M20SEL Not Asserted (16 bit mode)
Fill Frame
0
1a
1b
D-Field
10
11
00
C-Field
0011
0011
0011
1111111
1111111
1111111
0000000
0000000
0000000
Fill Frame Structure
M20SEL Asserted (20 bit mode)
Fill Frame
0
1a
1b
D-Field
10
11
00
C-Field
0011
0011
0011
111111111
111111111
111111111
000000000
000000000
000000000
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PDF描述 |
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