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參數(shù)資料
| 型號(hào)： | GS4911BCNE3 |
| 廠商： | Gennum Corporation |
| 英文描述： | HD/SD/Graphics Clock and Timing Generator with GENLOCK |
| 中文描述： | 高清/標(biāo)清/圖形時(shí)鐘和定時(shí)發(fā)生器鎖相 |
| 文件頁數(shù)： | 31/113頁 |
| 文件大?。?/td> | 1017K |
| 代理商： | GS4911BCNE3 |
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GS4911B/GS4910B Data Sheet
36655 - 2
April 2006
31 of 113
2.3 AC Electrical Characteristics
Clock Output Drive Current
–
IO_VDD = 1.8V
current drive = LOW
–
5
–
mA
–
–
IO_VDD = 3.3V
current drive = LOW
–
7
–
mA
–
–
IO_VDD = 1.8V
current drive = HIGH
–
7
–
mA
–
–
IO_VDD = 3.3V
current drive = HIGH
–
14
–
mA
–
Output Voltage LVDS, Common
Mode
V
OCM
–
1.125
1.25
1.375
V
3
Output Voltage LVDS, Differential
V
ODIFF
–
–
350
–
mV
3
LVDS High-impedance Leakage
Current
–
To 1.8V or GND
–
–
1.4
uA
–
NOTES
1. All DC and AC electrical parameters within specification.
2. Assuming that the current being sourced or sinked is less than the Timing Output Drive Current specified.
3. Into a 100
Ω
termination connected between PCLK3 and PCLK3.
Table 2-1: DC Electrical Characteristics (Continued)
V
DD
= 1.8V, T
A
= 0°C to 70°C, unless otherwise specified.
Parameter
Symbol
Condition
Min
Typ
Max
Units
Notes
Table 2-2: AC Electrical Characteristics
V
DD
= 1.8V, T
A
= 0°C to 70°C, unless otherwise specified.
Parameter
Symbol
Condition
Min
Typ
Max
Units
Notes
System
Reference Detection Time
–
from when the
reference input is
first present
–
2
4
frames
–
Digital I/O
PCLK Output Frequency
–
–
3.375
–
165
MHz
–
PCLK Jitter
–
SD video standards
XTAL_VDD = 3.3V
–
350
–
ps
1, 2
–
HD & Graphics
video standards
XTAL_VDD = 3.3V
–
250
–
ps
1, 3
PCLK Duty Cycle
–
–
40
–
60
%
–
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| GS4915 | CONN,S/R,8 POS,254C-08-1, CLOSED END STRAIN RELIEF COVER |
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| GS6332UR19D1 | FC/PC F.O. SINGLE MODE IN-LINE ATTENUATOR 5 DB |
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參數(shù)描述 |
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