參數(shù)資料
型號(hào)： GS4911BCNE3
廠商： Gennum Corporation
英文描述： HD/SD/Graphics Clock and Timing Generator with GENLOCK
中文描述： 高清/標(biāo)清/圖形時(shí)鐘和定時(shí)發(fā)生器鎖相
文件頁數(shù)： 108/113頁
文件大小： 1017K
代理商： GS4911BCNE3
GS4911B/GS4910B Data Sheet
36655 - 2
April 2006
108 of 113
4.2 GS4910B Typical Application Circuit
NOTE: For a solution with the lowest output jitter, the GS1531 or GS1532
serializers are recommended for use with the GS4911B/GS4910B.
Controlled impedance
100-ohms differential
NOTE: The GS4910A inputs are 5V tolerant for
3V3 I/O operation only (IO_VDD=3V3)
The 10FID input must be
VID_PLL_GND
XTAL_VDD
X1
X2
XTAL_GND
CORE_GND
ANALOG_VDD
NC
ANALOG_GND
ANALOG_GND
ANALOG_GND
10FID
HSYNC
4
5
6
7
8
9
VID_PLL_VDD
3
P
5
P
5
10
11
12
13
14
15
16
V
1
I
1
F
1
N
2
V
2
V
2
V
2
V
2
V
2
V
2
N
2
N
2
N
3
I
3
C
2
A
3
ANALOG_GND
33
ANALOG_GND
34
TIMING_OUT1
35
TIMING_OUT2
36
IO_VDD
38
37
TIMING_OUT4
39
TIMING_OUT3
TIMING_OUT5
40
LVDS/PCLK3_VDD
CORE_VDD
45
44
PCLK3
46
LVDS/PCLK3_GND
48
47
PCLK3
P
4
P
5
P
5
I
5
TIMING_OUT6
41
TIMING_OUT7
42
TIMING_OUT8
43
P
5
LOCK_LOST
REF_LOST
1
2
G
6
J
5
S
5
S
5
S
5
C
6
R
6
I
6
N
6
GND_PAD
65
10n
10n
10n
10n
22R
22R
22R
22R
22R
22R
22R
10n
0R
10n
24pF
22R
10n
GS4910B
10n
38pF
10n
22R
10n
1M
10n
22R
10n
10n
1V8_PCLK
VDD_IO
1V8_CORE
GND_XTAL
1V8_CORE
VDD_IO
VDD_IO
1V8_VPLL
1V8_VPLL
GND_VPLL
1V8_PCLK
VDD_IO
GND_VPLL
GND_A
VDD_XTAL
GND_XTAL
1V8_A
GND_A
GND_A
HSYNC
VSYNC
FSYNC
10FID
TIMING1
TIMING2
TIMING3
TIMING4
TIMING5
TIMING6
TIMING7
TIMING8
CSb
RESETb
SDIN
SDOUT
SCLK
PCLK2
PCLK3
PCLK3b
PCLK1
GENLOCKb
JTAG/HOSTb
VID_STD0
VID_STD1
VID_STD2
VID_STD3
VID_STD4
VID_STD5
LOCK_LOST
REF_LOST
27MHz
相關(guān)PDF資料
PDF描述
GS4915 CONN,S/R,8 POS,254C-08-1, CLOSED END STRAIN RELIEF COVER
GS6332 3 Pin, Low-Power, P Reset Circuits
GS6332UR15D1 3 Pin, Low-Power, P Reset Circuits
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GS6332UR19D1 FC/PC F.O. SINGLE MODE IN-LINE ATTENUATOR 5 DB
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參數(shù)描述
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