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參數(shù)資料
| 型號： | SCD243110QCD |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4 CHANNEL(S), 134.4K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封裝： | METRIC, QFP-100 |
| 文件頁數(shù)： | 20/186頁 |
| 文件大?。?/td> | 2204K |
| 代理商： | SCD243110QCD |
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CD2431 — Advanced Multi-Protocol Communications Controller
116
Datasheet
Channel Control Commands (Bit 7 = 0)
Bit 7
Must be ‘0’.
Bit 6
Clear Channel Command
When this command is issued, the CD2431 clears the data FIFOs and current trans-
mit and receive status of the channel in the CSR. If the channel is currently transmit-
ting a frame in synchronous protocol, the host should issue the transmit abort special
transmit command, before issuing a Clear command. The channel parameters are not
affected by a Clear Channel command. This command causes both receive and trans-
mit FIFOs to be cleared, the transmitter and receiver to be disabled, and all DMA
Status registers (DMABSTS, A/BRBSTS and A/BTBSTS) to be cleared.
Bit 5
Initialize Channel
If any change is made to the Protocol Mode Select bits in the CMR (Channel Mode
register) or to the COR1, the channel must be reinitialized by this command. The
InitCh command causes the internal protocol-specific registers to be initialized.
Warning:
If the Initialize Channel command is issued after a channel is already in operation, then a Clear
Channel command must be issued prior to, or coinciding with the Initialize Channel command.
Failure to observe this requirement will result in unpredictable device behavior.
Bit 4
Reset All
An on-chip firmware initialization of all channels is performed. All channel and glo-
bal parameters are reset to their power-on reset condition. This command is the
strongest the host can issue. None of the other command bits are interpreted if the
RESET ALL command is given. The host must re-initialize the CD2431 following
the execution of this command just as after a hardware power-on reset. When this
command is complete, the GFRCR is updated with the firmware revision code.
Bit 3
Enable Transmitter
Enables the transmitter by setting the TxEn bit (CSR[3]). In Asynchronous mode,
this command also clears the transmit flow control options.
Bit 2
Disable Transmitter
Disables the transmitter by clearing the TxEn bit (CSR[3]). In Asynchronous mode,
the Transmit Flow Control bits are cleared.
Bit 1
Enable Receiver
Enables the receiver by setting the RxEn bit (CSR[7]). In Asynchronous mode, the
Receive Flow Control bits are cleared.
Bit 0
Disable Receiver
Disables the receiver by clearing the RxEn bit (CSR[7]). In Asynchronous mode, the
Receive Flow Control bits are cleared.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SCG2500AI-019.44M | 51.84 MHz, OTHER CLOCK GENERATOR, DSO14 |
| SCG4525 | 4000/14000/40000 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), DSO18 |
| SCN2641CC1A28 | 1 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PQCC28 |
| SCN2681TC1A44A | 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PQCC44 |
| SCN68562C2N48 | 2 CHANNEL(S), 4M bps, MULTI PROTOCOL CONTROLLER, PDIP48 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SCD248110QCD | 功能描述:IC 4CH WAN COMMUN CTRL 100QFP RoHS:否 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN（6x6） 包裝:* 其它名稱:Q6396337A |
| SCD24H | 制造商:ZOWIE 制造商全稱:Zowie Technology Corporation 功能描述:Schottky Barrier Diode |
| SCD24L | 制造商:ZOWIE 制造商全稱:Zowie Technology Corporation 功能描述:SURFACE MOUNT LOW VF SCHOTTKY BARRIER RECTIFIER |
| SCD24LH | 制造商:ZOWIE 制造商全稱:Zowie Technology Corporation 功能描述:Schottky Barrier Diode |
| SCD255K851A3L28-A | 制造商:Cornell Dubilier Electronics 功能描述:CAPACITOR PP MODULE, 2.5UF, 850V, Product Range:CORNELL DUBILIER - SCD Series, C 制造商:Cornell Dubilier Electronics 功能描述:FILM CAPACITOR |
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