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參數(shù)資料
| 型號(hào)： | SCD243110QCD |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4 CHANNEL(S), 134.4K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封裝： | METRIC, QFP-100 |
| 文件頁數(shù)： | 118/186頁 |
| 文件大小： | 2204K |
| 代理商： | SCD243110QCD |
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Advanced Multi-Protocol Communications Controller — CD2431
Datasheet
37
5.2.1
Contexts and Channels
The registers in the CD2431 are grouped into Global, Virtual, and four sets of Per-Channel
registers. The CD2431 is normally in the background context, where the CAR (Channel Access
register) selects the channel number for the Per-Channel registers. The interrupt context begins
with the interrupt acknowledge bus cycle, and ends with a write access to the appropriate End of
Interrupt register. In the interrupt context, only the Per-Channel registers for the channel number
being serviced are available; the CAR has no effect. Most Global registers are available at all times,
but some are shared by the four channels, such as the FIFO registers. These are called Virtual
registers, and must be accessed only during an interrupt context.
Interrupt contexts can be nested so that a higher-priority interrupt service can preempt a lower
priority interrupt already in progress. The CD2431 pushes the current interrupt context onto the
stack, visible in the STK (Stack register), and enters the context for the newly acknowledged
interrupt. Any register accesses are in the new interrupt context until the host performs a write to
the appropriate EOIR for the top-level context. The CD2431 then pops the top-level context off the
stack and returns to the previous interrupt context.
5.2.2
Interrupt Registers
The IER (Interrupt Enable register) and the LIVR (Local Interrupt Vector register) are Per-Channel
registers. IER contains bits to enable or disable the various interrupt sources within the CD2431.
The LIVR value is output on the data bus during the interrupt acknowledge cycle. There are sets of
three Global registers that correspond to the three types of interrupts: Receive, Transmit, and
Modem. The Priority Interrupt Level registers (RPILR, TPILR, and MPILR) are programmed to
contain the value that is present on the address bus during the interrupt acknowledge bus cycle for
each type of interrupt. The Interrupt Status registers (RISR, TISR, or MISR) are examined during
the interrupt service routine to determine the cause of each type of interrupt. TDR and RDR
provide access to the FIFO buffers for each channel. These registers must not be accessed outside
of the proper interrupt context. A write operation to the End of Interrupt registers — REOIR,
TEOIR, or MEOIR must be the last access to the CD2431 at the end of this handler routine to
return it to its background context.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SCG2500AI-019.44M | 51.84 MHz, OTHER CLOCK GENERATOR, DSO14 |
| SCG4525 | 4000/14000/40000 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), DSO18 |
| SCN2641CC1A28 | 1 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PQCC28 |
| SCN2681TC1A44A | 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PQCC44 |
| SCN68562C2N48 | 2 CHANNEL(S), 4M bps, MULTI PROTOCOL CONTROLLER, PDIP48 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SCD248110QCD | 功能描述:IC 4CH WAN COMMUN CTRL 100QFP RoHS:否 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN（6x6） 包裝:* 其它名稱:Q6396337A |
| SCD24H | 制造商:ZOWIE 制造商全稱:Zowie Technology Corporation 功能描述:Schottky Barrier Diode |
| SCD24L | 制造商:ZOWIE 制造商全稱:Zowie Technology Corporation 功能描述:SURFACE MOUNT LOW VF SCHOTTKY BARRIER RECTIFIER |
| SCD24LH | 制造商:ZOWIE 制造商全稱:Zowie Technology Corporation 功能描述:Schottky Barrier Diode |
| SCD255K851A3L28-A | 制造商:Cornell Dubilier Electronics 功能描述:CAPACITOR PP MODULE, 2.5UF, 850V, Product Range:CORNELL DUBILIER - SCD Series, C 制造商:Cornell Dubilier Electronics 功能描述:FILM CAPACITOR |
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