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參數(shù)資料
| 型號： | S1C33L01F |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 50 MHz, RISC MICROCONTROLLER, PQFP176 |
| 封裝： | QFP18-176 |
| 文件頁數(shù)： | 581/591頁 |
| 文件大?。?/td> | 3916K |
| 代理商： | S1C33L01F |
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TABLE OF CONTENTS
iv
EPSON
Bus Clock.............................................................................................................................................................B-II-4-18
Bus Speed Mode ...............................................................................................................................B-II-4-19
Bus Clock Output ...............................................................................................................................B-II-4-19
Bus Cycles in External System Interface................................................................................................B-II-4-20
SRAM Read Cycles...........................................................................................................................B-II-4-20
Bus Timing............................................................................................................................................B-II-4-21
SRAM Write Cycles ...........................................................................................................................B-II-4-22
Burst ROM Read Cycles .................................................................................................................B-II-4-24
DRAM Direct Interface....................................................................................................................................B-II-4-25
Outline of DRAM Interface..............................................................................................................B-II-4-25
DRAM Setting Conditions...............................................................................................................B-II-4-26
DRAM Read/Write Cycles...............................................................................................................B-II-4-29
DRAM Refresh Cycles .....................................................................................................................B-II-4-32
Releasing External Bus .................................................................................................................................B-II-4-33
Power-down Control by External Device ................................................................................................B-II-4-34
I/O Memory of BCU .........................................................................................................................................B-II-4-35
II-5 ITC (Interrupt Controller) .................................................................................B-II-5-1
Outline of Interrupt Functions.........................................................................................................................B-II-5-1
Maskable Interrupts.............................................................................................................................B-II-5-1
Interrupt Factors and Intelligent DMA...........................................................................................B-II-5-3
Nonmaskable Interrupt (NMI)..........................................................................................................B-II-5-3
Interrupt Processing by the CPU....................................................................................................B-II-5-3
Clearing Standby Mode by Interrupts...........................................................................................B-II-5-3
Trap Table.............................................................................................................................................................B-II-5-4
Control of Maskable Interrupts ......................................................................................................................B-II-5-5
Structure of the Interrupt Controller ..............................................................................................B-II-5-5
Processor Status Register (PSR)...................................................................................................B-II-5-5
Interrupt Factor Flag and Interrupt Enable Register...............................................................B-II-5-6
Interrupt Priority Register and Interrupt Levels .........................................................................B-II-5-8
IDMA Invocation..................................................................................................................................................B-II-5-9
HSDMA Invocation...........................................................................................................................................B-II-5-11
I/O Memory of Interrupt Controller.............................................................................................................B-II-5-12
Programming Notes.........................................................................................................................................B-II-5-21
II-6 CLG (Clock Generator) ....................................................................................B-II-6-1
Configuration of Clock Generator.................................................................................................................B-II-6-1
I/O Pins of Clock Generator ...........................................................................................................................B-II-6-2
High-Speed (OSC3) Oscillation Circuit.......................................................................................................B-II-6-2
PLL .........................................................................................................................................................................B-II-6-3
Controlling Oscillation.......................................................................................................................................B-II-6-3
Setting and Switching Over the CPU Operating Clock.........................................................................B-II-6-3
Power-Control Register Protection Flag ....................................................................................................B-II-6-4
Operation in Standby Mode ...........................................................................................................................B-II-6-5
I/O Memory of Clock Generator....................................................................................................................B-II-6-6
Programming Notes...........................................................................................................................................B-II-6-9
II-7 DBG (Debug Unit) ............................................................................................B-II-7-1
Debug Circuit........................................................................................................................................................B-II-7-1
I/O Pins of Debug Circuit.................................................................................................................................B-II-7-1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S1C33L17B00E100 | MICROCONTROLLER, PBGA180 |
| S1C33T01F0A0100 | 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176 |
| S1C38000B0A0100 | 32-BIT, RISC MICROCONTROLLER, BGA239 |
| S1C60L02F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S1C33L03 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcontroller |
| S1C33L05 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcomputer |
| S1C33L11 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcomputer |
| S1C33L15 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33L17 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
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