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參數(shù)資料
| 型號： | MPC106 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 56/398頁 |
| 文件大?。?/td> | 1112K |
| 代理商： | MPC106 |
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2-18
MPC106 PCIB/MC User's Manual
MOTOROLA
transaction. Refer to Section 4.3.2.2, “TBST and TSIZ[0–2] Signals
and Size of Transfer,” for transfer size encodings.
Assertion/Negation—The same as A[0–31].
High-impedance—The same as A[0–31].
Timing Comments
2.2.2.17.2 Transfer Size (TSIZ[0–2])—Input
Following are the state meaning and timing comments for TSIZ[0–2] as input signals.
State Meaning
Asserted/Negated—In conjunction with the transfer burst (TBST)
signal, TSIZ[0–2] specify the data transfer size for the 60x bus
transaction. Refer to Section 4.3.2.2, “TBST and TSIZ[0–2] Signals
and Size of Transfer,” for transfer size encodings.
Timing Comments
Assertion/Negation—The same as A[0–31].
High-impedance—The same as A[0–31].
2.2.2.18 Transfer Type (TT[0–4])
The transfer type (TT[0–4]) signals consist of five input and output signals on the MPC106.
2.2.2.18.1 Transfer Type (TT[0–4])—Output
Following are the state meaning and timing comments for TT[0–4] as output signals.
State Meaning
Asserted/Negated—Specifies the type of 60x bus transfer in progress
for snooping. Refer to Section 4.3.2.1, “Transfer Type Signal
Encodings,” for transfer type encodings.
Timing Comments
Assertion/Negation—The same as A[0–31].
High-impedance—The same as A[0–31].
2.2.2.18.2 Transfer Type (TT[0–4])—Input
Following are the state meaning and timing comments for TT[0–4] as input signals.
State Meaning
Asserted/Negated—Specifies the type of 60x bus transfer in
progress. Refer to Section 4.3.2.1, “Transfer Type Signal
Encodings,” for transfer type encodings.
Timing Comments
Assertion/Negation—The same as A[0–31].
High-impedance—The same as A[0–31].
2.2.2.19 Write-Through (WT)—Input/Output
The write-through (WT) signal is both an input and output signal on the MPC106.
Following are the state meaning and timing comments for the WT signal.
State Meaning
Asserted—Indicates that an access is write-through.
Negated—Indicates that an access is write-back. Note that WT is
always negated for snoop cycles initiated by the MPC106.
Timing Comments
Assertion/Negation—The same as A[0–31].
High-impedance—The same as A[0–31].
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PDF描述 |
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