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參數(shù)資料
| 型號： | MPC106 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 398/398頁 |
| 文件大?。?/td> | 1112K |
| 代理商： | MPC106 |
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Index-12
MPC106 PCIB/MC User's Manual
MOTOROLA
INDEX
Timeout
, PCI transaction,
7-11
Timing diagrams
60x single-beat/burst data transfers,
4-19
acronyms in DRAM timing diagrams,
6-13
CBR refresh timing, SDRAM,
6-58
CF_L2_HIT_DELAY,
3-61
,
4-5
,
4-21
,
5-26
CF_WMODE,
5-27
DRAM RTC refresh in suspend mode,
6-29
DRAM/EDO
interface timing,
6-12
interface timing with ECC,
6-22
refresh,
6-26
self-refresh in sleep and suspend modes,
6-29
L2 cache
burst read,
5-39
burst read line update,
5-40
burst write,
5-41
castout timing,
5-34
castout timing with no ARTRY,
5-35
hit following PCI read snoop,
5-36
invalidate following PCI read snoop,
5-38
push following PCI write snoop,
5-37
read hit timing,
5-31
update timing,
5-33
write hit timing,
5-32
legend for L2 interface timing,
5-30
ROM/Flash
burst read timing,
6-65
Flash memory write,
6-68
interface timing,
6-65
single-byte read,
6-66
SDRAM
burst-of-four read,
6-50
burst-of-four write,
6-51
mode-set command timing,
6-55
self-refresh entry,
6-59
self-refresh exit,
6-60
single-beat read,
6-53
single-beat write,
6-54
TMS (JTAG test mode select) signal,
2-43
,
C-2
TOE (tag output enable) signal,
2-23
Transactions
fast back-to-back transactions, PCI bus,
7-14
PCI bus transactions,
7-8
PCI transaction termination,
7-11
Transfer
60x address/data tenure,
4-6
aligned data transfer, 60x,
4-14
transfer termination
,
4-16
TRDY (target ready) signal,
2-38
,
7-3
,
7-4
,
7-11
TRST (JTAG test reset) signal,
2-43
,
C-2
TS (transfer start) signal,
2-17
TSIZ
n
(transfer size) signals,
2-17
,
4-13
TT
n
(transfer type) signals,
2-18
,
4-10
Turnaround cycle and PCI bus,
7-8
TV (tag valid) signal,
2-23
,
5-10
TWE (tag write enable) signal,
2-23
,
5-24
W
WE (write enable) signal,
2-33
Write-back
L2 cache response,
5-12
support for L2 cache operation,
5-2
write-back cache with MPC106,
5-2
Write-through
L2 cache response,
5-20
support for L2 cache operation,
5-2
write-through cache with MPC106,
5-2
Write-with-autoprecharge command, SDRAM,
6-47
WT (write-through) signal,
2-18
,
5-12
X
XATS (extended address transfer) signal,
2-19
,
3-33
,
4-20
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC107 | 32-Bit Microprocessor(32位微處理器) |
| MPC505 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC509 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC5200BV400 | MPC5200 Hardware Specifications |
| MPC5200CBV266 | MPC5200 Hardware Specifications |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC106ARX66CE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66CG | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述: |
| MPC106ARX66DE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66DG | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66TE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
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