參數(shù)資料
型號： MC68360FE25
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240
封裝： CERAMIC, QFP-240
文件頁數(shù)： 919/962頁
文件大?。?/td> 26435K
代理商： MC68360FE25
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RISC Microcode from RAM
C-4
MC68360 USER’S MANUAL
All receive data is timestamped.
Handles 2, 4, 8, or 16 ISDN lines with full C/I and monitor channel functions.
Handles up to 32 ISDN lines with only C/I channels.
Simultaneous detection of multiple C/I code changes and transmission changes.
Maskable interrupts generated for many events.
Handles GCI monitor messages from 1 to 64 Kilobytes in length.
Monitor receiver can be locked into a particular channel.
Monitor receiver and transmitter include timers to prevent lockup due to inactivity.
Operates independently of user CPU activity.
Consumes 1280 bytes of the QUICC’s internal memory.
C.2.3 Performance
At 25Mhz, an MGCI serial bit rate of 2 Mbps on one SCC consumes 20 - 25% of the pro-
cessing power of the RISC communications engine. An MGCI SCC operating at a serial bit
rate of 2Mbps carries 32 x 64Kbit channels, Table C-2 shows possible QUICC configuration.
C.3 ATOM1/ATM CONTROLLER
ATOM1 provides physical layer ATM functions by converting one or more of the QUICC’s
Serial Communication Controllers (SCCs) into an ATM cell transmitter and receiver. The
microcode provides the user with basic cell streaming facilities (cell reception and transmis-
sion) and event indications. The primary application of ATOM1 is intended to be plesiochro-
nous digital hierarchy (PDH) and synchronous digital hierarchy (SDH) E1 and DS1 ATM
equipment. Such equipment is used for signalling and low rate data transfer.
Figure C-2 shows an ATM / frame relay interworking system as may be used in remote
bridging applications. Using the Ethernet channel available on the QUICC, remote LAN
bridging equipment can be constructed to link remote Ethernet LANs over E1 telecommuni-
cations links.
C.3.1 Key Features
Cell transmission and reception for all AAL protocols.
Transmit and receive data buffers located in main memory.
Microcode constructs the cell header and appends user defined payload on transmit.
Microcode verifies cell headers and strips HEC before passing cell to the user on re-
ceive.
Table C-2. MGCI SCC Configuration
MGCI SCCs
Risc Bandwidth
Consumed (est)
Possible Configuration of Other Channels
1 x 2 Mbit/s
25%
3 x 2 Mbit HDLC, 2 x 9.6 Kbit SMC UART
2 x 2 Mbit/s
50%
2 x 2 Mbit HDLC, 2 x 9.6 Kbit SMC UART
F
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r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
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n
c
..
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PDF描述
MC68360CFE25 RISC MICROCONTROLLER, CQFP240
MC68EN360FE25 RISC MICROCONTROLLER, CQFP240
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MC68EN360RC25V RISC MICROCONTROLLER, CPGA241
MC68MH360FE25 RISC MICROCONTROLLER, CQFP240
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MC68360FE25V 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual
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MC68360RC25 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual
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