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參數(shù)資料
| 型號(hào)： | MC68360FE25 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 72/962頁 |
| 文件大?。?/td> | 26435K |
| 代理商： | MC68360FE25 |
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CPU32+
MC68360 USER’S MANUAL
5.3.3.4 LOGIC INSTRUCTIONS. The logical operation instructions (AND, OR, EOR, and
NOT) perform logical operations with all sizes of integer data operands. A similar set of
immediate instructions (ANDI, ORI, and EORI) provide these logical operations with all sizes
of immediate data. The test (TST) instruction arithmetically compares the operand with zero,
placing the result in the CCR. Table 5-6 summarizes the logical operations.
Table 5-5. Integer Arithmetic Operations
Instruction
Operand
Syntax
Operand
Size
Operation
ADD
Dn,
ea
ea, Dn
8, 16, 32
Source + Destination
Destination
ADDA
ea, An
16, 32
Source + Destination
Destination
ADDI
#
data, ea
8, 16, 32
Immediate Data + Destination
Destination
ADDQ
#
data, ea
8, 16, 32
Immediate Data + Destination
Destination
ADDX
Dn, Dn
– (An), – (An)
8, 16, 32
Source + Destination + X
Destination
CLR
ea
8, 16, 32
0 Destination
CMP
ea, Dn
8, 16, 32
(Destination – Source), CCR shows results
CMPA
ea, An
16, 32
(Destination – Source), CCR shows results
CMPI
#
data, ea
8, 16, 32
(Destination – Immediate Data), CCR shows results
CMPM
(An) +, (An) +
8, 16, 32
(Destination – Source), CCR shows results
CMP2
ea, Rn
8, 16, 32
Lower bound
≤ Rn ≤ Upper Bound, CCR shows results
DIVS/DIVU
DIVSL/DIVUL
ea, Dn
ea
, Dr:Dq
ea, Dq
ea, Dr:Dq
32/16
16:16
64/32
32:32
32/32
32
32/32
32:32
Destination/Source
Destination (signed or un-
signed)
EXT
Dn
8
16
16
32
Sign Extended Destination
Destination
EXTB
Dn
8
32
Sign Extended Destination
Destination
MULS/MULU
ea, Dn
ea, Dl
ea, Dh:Dl
16
× 16 32
32
× 32 32
32
× 32 64
Source
× Destination Destination (signed or un-
signed)
NEG
ea
8, 16, 32
0 – Destination
Destination
NEGX
ea
8, 16, 32
0 – Destination – X
Destination
SUB
ea, Dn
Dn,
ea
8, 16, 32
Destination – Source
Destination
SUBA
ea, An
16, 32
Destination – Source
Destination
SUBI
#
data, ea
8, 16, 32
Destination – Immediate Data
Destination
SUBQ
#
data, ea
8, 16, 32
Destination – Immediate Data
Destination
SUBX
Dn, Dn
– (An), – (An)
8, 16, 32
Destination – Source – X
Destination
TBLS/TBLU
ea, Dn
Dym:Dyn, Dn
8, 16, 32
Dyn – Dym
Temp
(Temp
× Dn [7:0]) Temp
(Dym
× 256) + Temp Dn
TBLSN/TBLUN
ea, Dn
Dym:Dyn, Dn
8, 16, 32
Dyn – Dym
Temp
(Temp
× Dn [7:0]) / 256 Temp
Dym + Temp
Dn
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
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n
c
..
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