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參數(shù)資料
| 型號： | MC68360FE25 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 854/962頁 |
| 文件大小： | 26435K |
| 代理商： | MC68360FE25 |
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Electrical Characteristics
10-56
MC68360 USER’S MANUAL
10.17 040 BUS TYPE SRAM/DRAM CYCLES AC ELECTRICAL
SPECIFICATIONS
(The electrical specifications in this document are preliminary
. See Figure 10-44–Figure 10-48)
NOTES:
1.Transfer attributes signals = SIZx, TTx, TMx, R/W, and LOCK.
2.TEA/TA should not be asserted on a DRAM burst access, or on the same clock or before RASx /
CSx is asserted
Num.
Characteristic
3.3 V or 5.0 V
5.0V
Unit
25.0 MHz
33.34MHz
Min
Max
Min
Max
280
Address Valid to BADD2–3 Valid
—
20
—
15
ns
280A
BADD2–3 Valid to CAS assertion
15
—
10
—
ns
281
Address Invalid to BADD2–3 Invalid
0
—
0
—
ns
282
Clock High to CS/RASLow (TSS40=0)
4
16
4
12
ns
283
Clock High to CS/RASHigh (CSNT40=0)
4
16
4
12
ns
284
Clock High to BRK Low
—
20
—
15
ns
284A Clock Low to BRK Low
—
20
—
15
ns
285
Clock High to BRK High
—
20
—
15
ns
286
Clock Low to CS /RASx Low (TSS40=1)
4
16
4
12
ns
287
Clock Low to CS /RASx High (CSNT40=1)
4
16
4
12
ns
2881
AddressTransfer Attributes Valid to Clock High
(TSS40=0)
12
—
11
—
ns
2892
TA
Low to Clock High (External Termination)
11
—
9
—
ns
2902
Clock High to TA High (External Termination)
—
20
—
15
ns
291
Clock High to OE Low (Read Cycles)
—
20
—
15
ns
292
Clock High to OE High (Read Cycles)
—
20
—
15
ns
293
Clock High to WE Low (Write Cycles)
—
20
—
15
ns
294
Clock High to WE High (Write Cycles)
—
20
—
15
ns
295
Clock High to CAS Low
4
13
4
10
ns
295A Clock High to CAS High (040 Burst Read only)
4
13
4
10
ns
296
Clock High to CAS High
4
13
4
10
ns
297
Clock Low to AMUX Low
3
16
3
12
ns
298
Clock High to AMUX High
3
16
3
12
ns
299
Clock High to BADD2–3 Valid (040 Burst Cycles)
4
20
4
15
ns
3002
TEA
Low to Clock High
11
—
ns
3012
Clock High to TEA High
2
20
2
15
ns
302
Data, Parity Valid to Clock High (Data, Parity Set-
up)
7—
6
—
ns
303
Clock High to Data, Parity Invalid (Data, Parity
Hold)
7—
5
—
ns
305
CLKO1 High (After TS low) to Parity Valid
—
20
—
15
ns
306
CLKO1 High (After TA low) to Parity Hi-Z
4
20
15
ns
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
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