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參數(shù)資料
| 型號： | MC68360FE25 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 521/962頁 |
| 文件大?。?/td> | 26435K |
| 代理商： | MC68360FE25 |
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Serial Communication Controllers (SCCs)
7-244
MC68360 USER’S MANUAL
Figure 7-68. QUICC Ethernet Serial CAM Interface
The CAM control logic uses RSTRT, in combination with the RXD and RCLK signals, to
store the destination address, source address, etc. and generate writes to the CAM for
address recognition. In addition, the RENA signal supplied from the EEST may be used to
abort the comparison if a collision occurs on the receive frame.
After the comparison occurs, the CAM control logic asserts the receive reject (RRJCT) pin,
if the current receive frame should be rejected. The QUICC Ethernet controller will then
immediately stop writing data to system memory and will reuse the buffer(s) for the next
frame. If the CAM wishes to accept the frame, the CAM control logic does nothing (RRJCT
is not asserted). If RRJCT is asserted, it must be asserted prior to the end of the receive
frame.
QUICC
SCC
TENA (RTS)
TCLK (CLKx)
RxD
RENA (CD)
RCLK (CLKx)
CLSN (CTS)
RSTRT
RRJCT
PARALLEL I/O
TX
TENA
TCLK
RX
RENA
RCLK
CLSN
LOOP
PASSIVE
EEST
MC68160
TO MEDIA
SHIFT REGISTER
AND
CAM CONTROL
CAM
BUFFERS
NOTE: The receive data is sent directly from the EEST serial interface to the CAM using RXD and RCLK. RSTRT is asserted
at the beginning of the destination address. RRJCT should be asserted during the frame to cause the frame to be rejected.
The system bus is used for CAM initialization and maintenance.
SYSTEM BUS
PREAMBLE
FRAME
CHECK
SEQUENCE
START
FRAME
DELIMITER
7 BYTES
46–1500 BYTES
DEST.
ADDR.
SOURCE
ADDR.
6 BYTES
2 BYTES
TYPE/
LENGTH
6 BYTES
RSTRT
RRJCT
RXD
FRAME REJECTED IF ASSERTED DURING FRAME RECEPTION.
FURTHER TRANSMISSIONS ON SYSTEM BUS CEASE, AND
BUFFER DESCRIPTORS ARE REUSED.
PB15–PB8
DATA
OPTIONAL
FRAME TAG
BYTE
ASSERTED ON SECOND DESTINATION
ADDRESS BIT FOR A DURATION OF ONE
BIT TIME.
SDACK2–SDACK1
1 BYTE
4 BYTES
TxD
F
re
e
sc
a
le
S
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m
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o
n
d
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c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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相關PDF資料 |
PDF描述 |
|---|---|
| MC68360CFE25 | RISC MICROCONTROLLER, CQFP240 |
| MC68EN360FE25 | RISC MICROCONTROLLER, CQFP240 |
| MC68360RC33 | RISC MICROCONTROLLER, CPGA241 |
| MC68EN360RC25V | RISC MICROCONTROLLER, CPGA241 |
| MC68MH360FE25 | RISC MICROCONTROLLER, CQFP240 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68360FE25C | 制造商:Motorola Inc 功能描述: |
| MC68360FE25V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360FE33C | 制造商:Motorola Inc 功能描述: |
| MC68360RC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
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