參數(shù)資料
型號(hào)： MC68360FE25
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240
封裝： CERAMIC, QFP-240
文件頁數(shù)： 458/962頁
文件大?。?/td> 26435K
代理商： MC68360FE25
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Serial Communication Controllers (SCCs)
7-186
MC68360 USER’S MANUAL
GLt—Glitch on Tx
A clock glitch was detected by this SCC on the transmit clock.
DCC—DPLL CS Changed
The carrier sense status as generated by the DPLL has changed state. The real-time sta-
tus may be found in SCCS. This is not the CD pin status (which is reported in port C), and
is only valid when the DPLL is used.
FLG—Flag Status
The HDLC controller has stopped or started receiving HDLC flags. The real-time status
may be obtained in SCCS.
IDL—Idle Sequence Status Changed
A change in the status of the serial line was detected on the HDLC line. The real-time sta-
tus of the line may be read in SCCS.
GRA—Graceful Stop Complete
A graceful stop, which was initiated by the GRACEFUL STOP TRANSMIT command, is
now complete. This bit is set as soon the transmitter has finished transmitting any frame
that was in progress when the command was issued. It will be set immediately if no frame
was in progress when the command was issued.
TXE—Tx Error
An error (CTS lost or underrun) occurred on the transmitter channel.
RXF—Rx Frame
A complete frame has been received on the HDLC channel. This bit is set no sooner than
two clocks after receipt of the last bit of the closing flag.
BSY—Busy Condition
A frame was received and discarded due to lack of buffers.
TXB—Transmit Buffer
A buffer has been transmitted on the HDLC channel. This bit is set no sooner than when
the last bit of the closing flag begins its transmission if the buffer is the last one in the
frame. Otherwise, this bit is set after the last byte of the buffer has been written to the
transmit FIFO.
RXB—Receive Buffer
A buffer has been received on the HDLC channel that was not a complete frame.
7.10.17.12 HDLC MASK REGISTER (SCCM). The SCCM is referred to as the HDLC mask
register when the SCC is operating as an HDLC controller. It is a 16-bit read-write register
with the same bit formats as the HDLC event register. If a bit in the HDLC mask register is
a one, the corresponding interrupt in the event register will be enabled. If the bit is zero, the
corresponding interrupt in the event register will be masked. This register is cleared upon
reset.
F
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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PDF描述
MC68360CFE25 RISC MICROCONTROLLER, CQFP240
MC68EN360FE25 RISC MICROCONTROLLER, CQFP240
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MC68EN360RC25V RISC MICROCONTROLLER, CPGA241
MC68MH360FE25 RISC MICROCONTROLLER, CQFP240
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MC68360FE25V 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual
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MC68360RC25 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual
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