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參數(shù)資料
| 型號(hào)： | MC68360FE25 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 515/962頁 |
| 文件大?。?/td> | 26435K |
| 代理商： | MC68360FE25 |
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Serial Communication Controllers (SCCs)
7-238
MC68360 USER’S MANUAL
—Physical—One 48-Bit Address Recognized or 64-Bin Hash Table for Physical Ad-
dresses
—Logical—64-Bin Group Address Hash Table plus Broadcast Address Checking
—Promiscuous—Receives All Addresses, but Discards Frame If Reject Pin Asserted
External CAM Support on Both Serial and System Bus Interfaces
Up to Eight Parallel I/O Pins May Be Sampled and Appended to Any Frame
Heartbeat Indication
Transmitter Network Management and Diagnostics
—Lost Carrier Sense
—Underrun
—Number of Collisions Exceeded the Maximum Allowed
—Number of Retries per Frame
—Deferred Frame Indication
—Late Collision
Receiver Network Management and Diagnostics
—CRC Error Indication
—Nonoctet Alignment Error
—Frame Too Short
—Frame Too Long
—Overrun
—Busy (Out of Buffers)
Error Counters
—Discarded Frames (Out of Buffers or Overrun Occurred)
—CRC Errors
—Alignment Errors
Internal and External Loopback Mode
7.10.23.3 LEARNING ETHERNET ON THE QUICC. The following paragraphs detail the
Ethernet functionality on the QUICC. However, they show the additions made to the stan-
dard SCC functionality to implement Ethernet. Therefore, the reader is encouraged to learn
the basics of the SCCs and the overall architecture of the CPM before attempting to learn
this section in great detail.
A first-time user of the QUICC who plans to use Ethernet on the QUICC should first read the
following sections of this user manual.
1. 7.1 RISC Controller, 7.2 Command Set, and 7.3 Dual-Port RAM. The RISC controller
is used to issue special commands to the Ethernet channel. The dual-port RAM is
used to load Ethernet parameters and initialize BDs for use by the Ethernet channel.
2. 7.7 SDMA Channels discusses how SDMA channels are used to transfer data to/from
the Ethernet channel and system memory.
3. 7.8.9 NMSI Configuration explains how clocks are routed to the SCCs through the
bank of clocks.
4. 7.10.1 SCC Overview contains more detailed information on the SCCs that are appli-
F
re
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68360CFE25 | RISC MICROCONTROLLER, CQFP240 |
| MC68EN360FE25 | RISC MICROCONTROLLER, CQFP240 |
| MC68360RC33 | RISC MICROCONTROLLER, CPGA241 |
| MC68EN360RC25V | RISC MICROCONTROLLER, CPGA241 |
| MC68MH360FE25 | RISC MICROCONTROLLER, CQFP240 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68360FE25C | 制造商:Motorola Inc 功能描述: |
| MC68360FE25V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360FE33C | 制造商:Motorola Inc 功能描述: |
| MC68360RC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
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