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參數(shù)資料
| 型號(hào)： | EVAL-ADUC7023QSPZ1 |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 46/96頁(yè) |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR ADUC7023 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | QuickStart™ PLUS 套件 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | ADuC7023 |
| 所含物品： | 板 |
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ADuC7023
Data Sheet
| Page 50 of 96
Table 52. POWCON0 Write Sequence
Name
Code
POWKEY1
0x01
POWCON0
User value
POWKEY2
0xF4
POWKEY3 Register
Name:
POWKEY3
Address:
0xFFFF0434
Default value:
0xXXXX
Access:
Write
Function:
POWKEY3 prevents accidental
programming to POWCON1.
POWKEY4 Register
Name
POWKEY4
Address
0xFFFF043C
Default Value
0xXXXX
Access
Write
Function:
POWKEY4 prevents accidental
programming to POWCON1.
POWCON1 Register
Name:
POWCON1
Address:
0xFFFF0438
Default value:
0x0004
Access:
Read/write
Table 53. POWCON1 MMR Bit Designations
Bit
Value
Name
Description
15 to 9
Reserved.
8
SPIPO
Clearing this bit powers
down the SPI.
7 to 6
SPICLKDIV
SPI block driving clock
divider bits.
00
41.78 MHz.
01
20.89 MHz.
10
10.44 MHz.
11
5.22 MHz.
5
I2C1PO
Clearing this bit powers
down the I2C1.
4 to 3
I2C1CLKDIV
I2C0 block driving clock
divider bits.
00
41.78 MHz.
01
10.44 MHz.
10
5.22 MHz.
11
1.31 MHz.
2
I2C0PO
Clearing this bit powers
down the I2C0.
1 to 0
I2C0CLKDIV
I2C1 block driving clock
divider bits.
00
41.78 MHz.
01
10.44 MHz.
10
5.22 MHz.
11
1.31 MHz.
1
Divided clock for SPI/I2C0/I2C1 must be greater than or equal to the CPU
clock as selected by POWCON0[2:0]
Table 54. POWCON1 Write Sequence
Name
Code
POWKEY3
0x76
POWCON1
User value
POWKEY4
0XB1
Rev. E
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| EVALADUC7023QSPZU1 | 制造商:Analog Devices 功能描述: |
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