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參數(shù)資料
| 型號： | XCF128XFTG64C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 43/88頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PROM SRL 128M GATE 64-FTBGA |
| 標準包裝： | 1 |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 存儲容量： | 128Mb |
| 電源電壓： | 1.7 V ~ 2 V |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-TBGA |
| 供應商設(shè)備封裝： | 64-TFBGA |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 601 (CN2011-ZH PDF) |
| 其它名稱： | 122-1578 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁當前第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁
Platform Flash XL High-Density Configuration and Storage Device
DS617 (v3.0.1) January 07, 2010
Product Specification
48
R
Table 28: Asynchronous Read AC Characteristics
Symbol
Alt
Parameter
Voltage Range
Units
VDDQ =
2.3V to 2.7V
VDDQ =
3.0V to 3.6V
Rea
d
Ti
mi
ng
s
TAVAV
TRC
Address valid to next address valid
Min
85
ns
TAVQV
TACC
Address valid to output valid (random)
Max
85
ns
TAVQV1
TPAGE
Address valid to output valid (page)
Max
30
ns
TAXQX(1)
TOH
Address transition to output transition
Min
0
ns
TELTV
Chip enable Low to wait valid
Max
17
ns
TELQV(2)
TCE
Chip enable Low to output valid
Max
85
ns
TELQX(1)
TLZ
Chip enable Low to output transition
Min
0
ns
TEHTZ
Chip enable High to wait Hi-Z
Max
17
ns
TEHQX(1)
TOH
Chip enable High to output transition
Min
0
ns
TEHQZ(1)
THZ
Chip enable High to output Hi-Z
Max
17
ns
TGLQV(2)
TOE
Output enable Low to output valid
Max
25
ns
TGLQX(1)
TOLZ
Output enable Low to output transition
Min
0
ns
TGLTV
Output enable Low to wait valid
Max
17
ns
TGHQX(1)
TOH
Output enable High to output transition
Min
0
ns
TGHQZ(1)
TDF
Output enable High to output Hi-Z
Max
17
ns
TGHTZ
Output enable High to wait Hi-Z
Max
17
ns
Latc
h
T
imi
ng
s
TAVLH
TAVADVH
Address valid to latch enable High
Min
10
ns
TELLH
TELADVH
Chip enable Low to latch enable High
Min
10
ns
TLHAX
TADVHAX
Latch enable High to address transition
Min
9
ns
TLLLH
TADVLADVH
Latch enable pulse width
Min
10
ns
TLLQV
TADVLQV
Latch enable Low to output valid
(random)
Max
85
ns
Notes:
1.
Sampled only, not 100% tested.
2.
G may be delayed by up to TELQV – TGLQV after the falling edge of E without increasing tELQV.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XCF32PFS48C | IC PROM SRL 1.8V 32M 48CSBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XCF12-S1 | 制造商:SAIA - BURGESS ELECTRONICS INC. 功能描述:Catalogue / XCF12-S1 |
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| XCF16P | 制造商:XILINX 制造商全稱:XILINX 功能描述:Platform Flash In-System Programmable Configuration PROMs |
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