參數(shù)資料
型號(hào)： S3S12XF512J0VLH
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： LQFP-64
文件頁數(shù)： 857/1306頁
文件大?。?/td> 8007K
代理商： S3S12XF512J0VLH
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Chapter 13 FlexRay Communication Controller (FLEXRAY)
MC9S12XF - Family Reference Manual, Rev.1.19
594
Freescale Semiconductor
13.6.12.3 Sync Frame ID and Sync Frame Deviation Table Setup
The FlexRay block writes a copy of the internal synchronization frame ID and deviation tables into the
FRM if requested by the application. The application must provide the appropriate amount of FRM for the
tables. The memory layout of the tables is given in Figure 13-138. Each table occupies 120 16-bit entries.
While the protocol is in POC:cong state, the application must program the offsets for the tables into the
13.6.12.4 Sync Frame ID and Sync Frame Deviation Table Generation
The application controls the generation process of the Sync Frame ID and Sync Frame Deviation Tables
summary of the copy modes is given in Table 13-112.
The Sync Frame Table generation process is described in the following for the even cycle. The same
sequence applies to the odd cycle.
If the application has enabled the sync frame table generation by setting SFTCCSR.SIDEN to 1, the
FlexRay block starts the update of the even cycle related tables after the start of the NIT of the next even
cycle. The FlexRay block checks if the application has locked the tables by reading the SFTCCSR.ELKS
lock status bit. If this bit is set, the FlexRay block will not update the table in this cycle. If this bit is cleared,
the FlexRay block locks this table and starts the table update. To indicate that these tables are currently
updated and may contain inconsistent data, the FlexRay block clears the even table valid status bit
SFTCCSR.EVAL. Once all table entries related to the even cycle have been transferred into the FRM, the
FlexRay block sets the even table valid bit SFTCCSR.EVAL and the Even Cycle Table Written Interrupt
Flag EVT_IF in the Protocol Interrupt Flag Register 1 (PIFR1). If the interrupt enable ag EVT_IE is set,
an interrupt request is generated.
To read the generated tables, the application must lock the tables to prevent the FlexRay block from
updating these tables. The locking is initiated by writing a 1 to the even table lock trigger
SFTCCSR.ELKT. When the even table is not currently updated by the FlexRay block, the lock is granted
and the even table lock status bit SFTCCSR.ELKS is set. This indicates that the application has
successfully locked the even sync tables and the corresponding status information elds SFRA, SFRB in
Table 13-112. Sync Frame Table Generation Modes
SFTCCSR
Description
OPT
SDVEN
SIDEN
0
No Sync Frame Table copy
0
1
Sync Frame ID Tables will be copied continuously
0
1
0
Reserved
0
1
Sync Frame ID Tables and Sync Frame Deviation Tables will be copied continuously
1
0
No Sync Frame Table copy
1
0
1
Sync Frame ID Tables for next even-odd-cycle pair will be copied
0
1
0
Reserved
1
Sync Frame ID Tables and Sync Frame Deviation Tables for next even-odd-cycle pair will be
copied
相關(guān)PDF資料
PDF描述
S9S12XF512J0CLMR MICROCONTROLLER, QFP112
SC9S12XF512J0VLMR MICROCONTROLLER, QFP112
MC9S12XHZ512CAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
MC9S12XHZ512VAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
MC9S12XHZ512MAG 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S3S12XF512J0VLHR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
S3S12XF512J0VLMR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
S3S3M 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR
S3S4M 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR
S3S-A10-AC110/120-210/240 制造商:OMRON Electronic Components LLC 功能描述:
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