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參數資料
| 型號： | S3S12XF512J0VLH |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, QFP64 |
| 封裝： | LQFP-64 |
| 文件頁數： | 432/1306頁 |
| 文件大?。?/td> | 8007K |
| 代理商： | S3S12XF512J0VLH |
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Chapter 7 Interrupt (S12XINTV2)
MC9S12XF - Family Reference Manual, Rev.1.19
210
Freescale Semiconductor
7.3.2.3
Interrupt Request Conguration Address Register (INT_CFADDR)
Read: Anytime
Write: Anytime
7.3.2.4
Interrupt Request Conguration Data Registers (INT_CFDATA0–7)
The eight register window visible at addresses INT_CFDATA0–7 contains the conguration data for the
block of eight interrupt requests (out of 128) selected by the interrupt conguration address register
(INT_CFADDR) in ascending order. INT_CFDATA0 represents the interrupt conguration data register
of the vector with the lowest address in this block, while INT_CFDATA7 represents the interrupt
conguration data register of the vector with the highest address, respectively.
Table 7-6. XGATE Interrupt Priority Levels
Priority
XILVL2
XILVL1
XILVL0
Meaning
0
Interrupt request is disabled
low
0
1
Priority level 1
0
1
0
Priority level 2
0
1
Priority level 3
1
0
Priority level 4
1
0
1
Priority level 5
1
0
Priority level 6
high
1
Priority level 7
Address: 0x0127
76543210
R
INT_CFADDR[7:4]
0000
W
Reset
0
10000
= Unimplemented or Reserved
Figure 7-5. Interrupt Conguration Address Register (INT_CFADDR)
Table 7-7. INT_CFADDR Field Descriptions
Field
Description
7–4
INT_CFADDR[7:4]
Interrupt Request Conguration Data Register Select Bits — These bits determine which of the 128
conguration data registers are accessible in the 8 register window at INT_CFDATA0–7. The hexadecimal
value written to this register corresponds to the upper nibble of the lower byte of the address of the interrupt
vector, i.e., writing 0xE0 to this register selects the conguration data register block for the 8 interrupt vector
requests starting with vector at address (vector base + 0x00E0) to be accessible as INT_CFDATA0–7.
Note: Writing all 0s selects non-existing conguration registers. In this case write accesses to
INT_CFDATA0–7 will be ignored and read accesses will return all 0.
相關PDF資料 |
PDF描述 |
|---|---|
| S9S12XF512J0CLMR | MICROCONTROLLER, QFP112 |
| SC9S12XF512J0VLMR | MICROCONTROLLER, QFP112 |
| MC9S12XHZ512CAL | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112 |
| MC9S12XHZ512VAL | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112 |
| MC9S12XHZ512MAG | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| S3S12XF512J0VLHR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| S3S12XF512J0VLMR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| S3S3M | 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR |
| S3S4M | 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR |
| S3S-A10-AC110/120-210/240 | 制造商:OMRON Electronic Components LLC 功能描述: |
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