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參數(shù)資料
| 型號： | S3S12XF512J0VLH |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, QFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 181/1306頁 |
| 文件大?。?/td> | 8007K |
| 代理商： | S3S12XF512J0VLH |
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Chapter 26 Enhanced Capture Timer (ECT16B8CV3)
MC9S12XF - Family Reference Manual, Rev.1.19
1160
Freescale Semiconductor
26.3.2.29 Pulse Accumulator B Flag Register (PBFLG)
Read: Anytime
Write used in the ag clearing mechanism. Writing a one to the ag clears the ag. Writing a zero will not
affect the current status of the bit.
NOTE
When TFFCA = 1, the ag cannot be cleared via the normal ag clearing
mechanism (writing a one to the ag). Reference Section 26.3.2.6, “Timer
All bits reset to zero.
PBFLG indicates when interrupt conditions have occurred. The ag can be cleared via the normal ag
clearing mechanism (writing a one to the ag) or via the fast ag clearing mechanism (Reference TFFCA
Table 26-37. PBCTL Field Descriptions
Field
Description
6
PBEN
Pulse Accumulator B System Enable — PBEN is independent from TEN. With timer disabled, the pulse
accumulator can still function unless pulse accumulator is disabled.
0 16-bit pulse accumulator system disabled. 8-bit PAC1 and PAC0 can be enabled when their related enable
bits in ICPAR are set.
1 Pulse accumulator B system enabled. The two 8-bit pulse accumulators PAC1 and PAC0 are cascaded to form
the PACB 16-bit pulse accumulator B. When PACB is enabled, the PACN1 and PACN0 registers contents are
respectively the high and low byte of the PACB.
PA1EN and PA0EN control bits in ICPAR have no effect.
The PACB shares the input pin with IC0.
1
PBOVI
Pulse Accumulator B Overow Interrupt Enable
0 Interrupt inhibited
1 Interrupt requested if PBOVF is set
Module Base + 0x0031
76543210
R
000000
PBOVF
0
W
Reset
00000000
= Unimplemented or Reserved
Figure 26-52. Pulse Accumulator B Flag Register (PBFLG)
Table 26-38. PBFLG Field Descriptions
Field
Description
1
PBOVF
Pulse Accumulator B Overow Flag — This bit is set when the 16-bit pulse accumulator B overows from
0xFFFF to 0x0000, or when 8-bit pulse accumulator 1 (PAC1) overows from 0x00FF to 0x0000.
When PACMX = 1, PBOVF bit can also be set if 8-bit pulse accumulator 1 (PAC1) reaches 0x00FF and an active
edge follows on IC1.
相關PDF資料 |
PDF描述 |
|---|---|
| S9S12XF512J0CLMR | MICROCONTROLLER, QFP112 |
| SC9S12XF512J0VLMR | MICROCONTROLLER, QFP112 |
| MC9S12XHZ512CAL | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112 |
| MC9S12XHZ512VAL | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112 |
| MC9S12XHZ512MAG | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| S3S12XF512J0VLHR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| S3S12XF512J0VLMR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers |
| S3S3M | 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR |
| S3S4M | 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR |
| S3S-A10-AC110/120-210/240 | 制造商:OMRON Electronic Components LLC 功能描述: |
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