參數(shù)資料
型號(hào)： S3S12XF512J0VLH
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： LQFP-64
文件頁(yè)數(shù)： 1030/1306頁(yè)
文件大?。?/td> 8007K
代理商： S3S12XF512J0VLH
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Chapter 1 MC9S12XF-Family Reference Manual
MC9S12XF - Family Reference Manual, Rev.1.19
Freescale Semiconductor
75
1.6.3
Effects of Reset
When a reset occurs, MCU registers and control bits are initialized. Refer to the respective block
descriptions for register reset states.
On each reset, the Flash module executes a reset sequence to load Flash conguration registers and
initialize the buffer RAM EEE partition, if required.
1.6.3.1
Flash Conguration Reset Sequence Phase (Core Hold Phase)
On each reset, the Flash module will hold CPU activity while loading Flash module registers and
conguration from the Flash memory. The duration of this phase is given as tRST in the device electrical
parameter specication. If double faults are detected in the reset phase, Flash module protection and
security may be active on leaving reset. This is explained in more detail in the Flash (FTM) module section.
1.6.3.2
EEE Reset Sequence Phase (Core Active Phase)
During this phase of the reset sequence (following on from the core hold phase) the CPU can execute
instructions while the FTM initialization completes and, if congured for EEE operation, the EEE RAM
is loaded with valid data from the D-Flash EEE partition. Completion of this phase is indicated by the
CCIF ag in the FTM FSTAT register becoming set. If the CPU accesses any EEE RAM location before
the CCIF ag is set, the CPU is stalled until the FTM reset sequence is complete and the EEE RAM data
is valid. Once the CCIF ag is set, indicating the end of this phase, the EEE RAM can be accessed without
impacting the CPU and FTM commands can be executed.
1.6.3.3
Reset While Flash Command Active
If a reset occurs while any Flash command is in progress, that command will be immediately aborted. The
state of the word being programmed or the sector/block being erased is not guaranteed.
1.6.3.4
I/O Pins
Refer to the PIM block description for reset congurations of all peripheral module ports.
Vector base + $16
—
XGATE software error interrupt
None
Vector base + $14
—
MPU Access Error
None
Vector base + $12
—
System Call Interrupt (SYS)
—
None
Vector base + $10
—
Spurious interrupt
—
None
1. 16 bits vector address based
2. For detailed description of XGATE channel ID refer to XGATE Block Guide
Table 1-13. Interrupt Vector Locations (Sheet 4 of 4)
Vector Address(1)
XGATE
Channel ID(2)
Interrupt Source
CCR
Mask
Local Enable
相關(guān)PDF資料
PDF描述
S9S12XF512J0CLMR MICROCONTROLLER, QFP112
SC9S12XF512J0VLMR MICROCONTROLLER, QFP112
MC9S12XHZ512CAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
MC9S12XHZ512VAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
MC9S12XHZ512MAG 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S3S12XF512J0VLHR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
S3S12XF512J0VLMR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:S12X Microcontrollers
S3S3M 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR
S3S4M 制造商:SHINDENGEN 制造商全稱:Shindengen Electric Mfg.Co.Ltd 功能描述:SEMICONDUCTOR
S3S-A10-AC110/120-210/240 制造商:OMRON Electronic Components LLC 功能描述:
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